[其他]支持源指令执行过程仿真的扩展浮点运算无效
申请号: | 87106442 | 申请日: | 1987-09-19 |
公开(公告)号: | CN87106442A | 公开(公告)日: | 1988-06-15 |
发明(设计)人: | 詹姆斯·阿莱克桑德·米彻尔;约翰·弗里德里克·比克德尔 | 申请(专利权)人: | 国际商用机器公司 |
主分类号: | G06F9/44 | 分类号: | G06F9/44 |
代理公司: | 中国国际贸易促进委员会专利代理部 | 代理人: | 姚珊 |
地址: | 美国*** | 国省代码: | 暂无信息 |
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摘要: | 在一个仿真源CPU指令执行的一个系统中,有一个把源指令转换为目标指令的翻译部件(翻译器)和一个用来处理和发放翻译后目标指令的目标CPU指令部件。在仿真某些源浮点算术指令的执行时,上述设施为加快指令的翻译、发放和执行提供了条件。当一条源浮点算术指令被仿真时,有一个令牌被放入翻译器中的等待队列中,以便在得到有效的条件码或中断信息之前阻止源指令的翻译和目标指令的发放。 | ||
搜索关键词: | 支持 指令 执行 过程 仿真 扩展 浮点 运算 | ||
【主权项】:
1、用来仿真源CPU指令执行的一个系统,该系统包括:一个主存器、一个作为加工和发放翻译后目标指令用的目标指令部件、若干执行目标指令用的目标功能部件和一个用于接收源指令并把源指令翻译为目标指令的指令翻译部件(翻译器),及一种用以加快源指令的翻译和执行的改进,其特征在于:在所说的翻译器中有一种设施,在源浮点算术指令的翻译过程中,这种设施能产生一个浮点令牌信号;在所说的浮点部件中有一个结果设施,它能够产生结束信号以指出翻译后得到的那条目标浮点指令的执行结果,所说的结果信号能在所说的被发现的目标浮点指令执行完成之前生成;在所说的与上述系统设施相连的翻译器中,还有一个多级等待队列,用来接收所说的令牌信号并随着上述翻译过程的要求把此令牌信号移到一个等待阶段,在上述的结束信号出现后再从所说的等待阶段中转去所说的等待令牌信号;还有一个与所述的等待阶段相连的系统设施,用在所说的等待阶段中如果有等待令牌信号的话就限制指令的翻译和发放。
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