[发明专利]动态加法器无效
申请号: | 88102231.4 | 申请日: | 1988-04-30 |
公开(公告)号: | CN1012394B | 公开(公告)日: | 1991-04-17 |
发明(设计)人: | 金慧生 | 申请(专利权)人: | 北京市粮食科学研究所 |
主分类号: | G06F7/62 | 分类号: | G06F7/62 |
代理公司: | 商业部专利代理事务所 | 代理人: | 李树昌,孙福春 |
地址: | 北京市宣武区*** | 国省代码: | 北京;11 |
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摘要: | 本发明的动态加法器电路,设有两个整形器,把A、B端输入的脉冲信号变为脉冲宽度相同的信号,然后根据“与”逻辑关系和“或”的逻辑关系组成两个计数脉冲发生系统,最后将这两个系统产生的计数脉冲相加,作为动态加法器输出。本电路取消了锁存器,采用在动态中直接把各路脉冲相加,因而具有动态误差小,功耗低,价格低廉等优点。 | ||
搜索关键词: | 动态 加法器 | ||
【主权项】:
1、一种“动态加法器”具有不需指令控制即可随时将多路脉冲信号相加的功能,其特征是:脉冲信号从A、B端输入,经过整形后,变为脉冲宽度相同的标准脉冲,单稳触发器D1的输出端接“或门”G1的输入端和“与门”G3的输入端,单稳触发器D2的输出端接G1的另一输入端和G3的另一输入端,“与门”G2的三个输入端分别接G1的输出端、单稳触发器D3和D4的“Q”端,G2的输出上升沿触发D3,D3的“Q”端接“或门”G4的输入端,“与门”G3的输出上升沿触发D4,D4“Q”端输出下降沿触发D5,D5的“Q”端接G4的另一输入端,G4的输出为动态加法器的输出。
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