[发明专利]具有可编程锁定功能控制的双总线微计算机系统无效
| 申请号： | 90103769.9 | 申请日： | 1990-05-24 |
| 公开（公告）号： | CN1019237B | 公开（公告）日： | 1992-11-25 |
| 发明（设计）人： | 拉尔夫M·贝根;帕特里克M·布兰德;菲利浦E·米尔林 | 申请（专利权）人： | 国际商业机器公司 |
| 主分类号： | G06F13/20 | 分类号： | G06F13/20 |
| 代理公司： | 中国国际贸易促进委员会专利代理部 | 代理人： | 付康 |
| 地址： | 美国*** | 国省代码： | 暂无信息 |
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| 摘要： | 一种双总线微计算机系统包括一个高速缓冲存储器子系统以允许对LOCK(锁定)功能的可编程控制来改进某些情况中的性能。更具体地在CPU的LOCK输出与高速缓冲存储器控制器的LOCK输入之间耦合有附加的逻辑。来自一个I/O端口的一个控制位是对该附加逻辑的一个第二输入。该控制位在一种状态时，该逻辑允许LOCK输入跟随LOCK输出，在该控制位的另一种状态。不考虑LOCK输出的状态LOCK输入被禁阻。 | ||
| 搜索关键词： | 具有 可编程 锁定 功能 控制 总线 计算机系统 | ||
【主权项】：
1.一种多总线微计算机系统包括：以一条CPU本地总线连接在一起的一个CPU及一个高速缓冲存储器子系统，所述高速缓冲存储器子系统包括一个高速缓冲存储器控制器及一个高速缓冲存储器，将所述高速缓冲存储器控制器连接到一个随机访问存储器与多个可寻址功能单元的系统总线装置，所述CPU有一个LOCK(锁定)输出且所述高速缓冲存储器有一个LOCK输入，所述高速缓冲存储器控制器包括用于将一个激活的LOCK输入相关联的任何周期作为非高速缓冲存储周期对待的装置，其特征在于：耦合在所述CPU的所述LOCK输出与所述高速缓冲存储器控制器的所述LOCK输入之间的逻辑装置，所述逻辑装置包括一个用于禁阻所述LOCK输出与所述LOCK输入之间的任何关系的控制输入。
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