[发明专利]改进的模拟数字神经元、神经网络及网络调试算法无效
| 申请号： | 93102861.2 | 申请日： | 1993-03-13 |
| 公开（公告）号： | CN1076536A | 公开（公告）日： | 1993-09-22 |
| 发明（设计）人： | 肯尼斯·奥斯汀 | 申请（专利权）人： | 皮尔金顿电子有限公司 |
| 主分类号： | G06F15/20 | 分类号： | G06F15/20;G06G7/60 |
| 代理公司： | 中国国际贸易促进委员会专利代理部 | 代理人： | 王以平 |
| 地址： | 英国默*** | 国省代码： | 暂无信息 |
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| 摘要： | 一完善的模拟数字神经元，增强的模拟神经网络结构以及一简调试工作的神经网络调试算法。此数字神经元包括具有2n存贮单元(一位)的随机存取存贮器的n位输入一位输出的装置。由一网络调试算法按神经元激活状态，根据针对神经网络内加的神经元而分配到输入编码组合模式的突触加权值加以编程。此数字神经元起一查表装置的作用，为每一加到其输入通路的n位数字编码模式。求取神经元激活状态。 | ||
| 搜索关键词： | 改进 模拟 数字 神经元 神经网络 网络 调试 算法 | ||
【主权项】：
1、一用于一神经网络中的数字神经元，此数字神经元包括有一具有2n存贮单元的随机存取存贮器，一个存贮单元针对每一个n输入的编码模式，每一存贮单元以神经元的激活状态(活动或不活动)被加以编程，这些激活状态对应于由一神经网络调试算法分配给针对一神经网络中的该神经元的输入编码模式的突触加权值，此神经元起一查表装置的作用，以为被送到神经元输入通路的每一个n位数字编码模式从被该n位数字输入编码模式所寻址的该随机存取存贮单元求取神经元激活状态。
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