[发明专利]锁相环合成器及其控制方法无效

专利信息
申请号: 95100247.3 申请日: 1995-01-19
公开(公告)号: CN1057882C 公开(公告)日: 2000-10-25
发明(设计)人: 山下和郎;井上昭治;江川政彦;佐久间浩昭;足立诚幸 申请(专利权)人: 日本无线株式会社
主分类号: H03L7/20 分类号: H03L7/20
代理公司: 中国专利代理(香港)有限公司 代理人: 吴增勇,王忠忠
地址: 日本*** 国省代码: 暂无信息
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摘要: 由高速时间常数电路32确定的时间常数适于高速牵引输出频率fo,而由低速时间常数电路33确定的时间常数适于稳定输出频率相应值和抑制寄生输出频率。例如,当输出频率从fo切换到fb时,是在开关Sa为ON、开关Sb为OFF时通过设置分频比率n切换的。同样,开关Sa关断,输出频率稳定后,开关Sb打开。提高了输出频率切换速度以及在频率切换后抑制寄生输出频率而无须使用高精度的A/D变换器或D/A变换器。
搜索关键词: 环合 成器 及其 控制 方法
【主权项】:
1.一种锁相环合成器,包含:一个以取决于所加控制电压的输出频率振荡的振荡器(4);一个用于按照所需输出频率对输出频率分频的分频器(1);一个用于通过参照作为输出频率基准的基准频率检测分频输出频率的相位以产生控制电压的检测器(2);以及一个通过对由所述检测器(2)产生的控制电压进行滤波而稳定输出频率并将滤波后的控制电压送到所述振荡器(4)的环路滤波器(3a、3b);所述环路滤波器(3a、3b)包括:始终插在所述检测器(2)与所述振荡器(4)之间,并有一个设置成在改变所需输出频率时有一个预定的第一时间常数,使得由所述振荡器产生的输出频率以高速逐步改变为一个新的输出频率的高速时间常数电路(32);在需要时插在所述检测器(2)与所述振荡器(4)之间的低速时间常数电路(33、34),该低速时间常数电路有一个预定的第二时间常数,该第二时间常数这样设置使得由于基准频率的误差或分频输出频率的误差造成的寄生输出频率在低速时间常数电路(33、34)插在所述检测器和所述振荡器之间时被抑制;当所述低速时间常数电路(33、34)不插在所述检测器(2)与所述振荡器(4)之间时,所述低速时间常数电路(33、34)保持表示它插在所述检测器(2)与所述振荡器(4)之间时所要输出的频率的信息;以及切换装置,用于在需要时通过所述低速时间常数电路(33、34)形成和切断所述检测器(2)与所述振荡器(4)之间的信号通道。
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