[发明专利]数据存储装置无效

专利信息
申请号: 96104159.5 申请日: 1996-03-29
公开(公告)号: CN1082765C 公开(公告)日: 2002-04-10
发明(设计)人: 佐藤真史;藤井省造 申请(专利权)人: 松下电器产业株式会社
主分类号: H04N5/907 分类号: H04N5/907
代理公司: 中国国际贸易促进委员会专利商标事务所 代理人: 王以平
地址: 日本*** 国省代码: 暂无信息
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摘要: 能高效率地使用通用DRAM作为数字数据的差错订正和修改处理时的存储器的数据存储装置。由DADM、DRAM存取部、和差错订正电路构成。被输入的数字数据首先在差错订正电路中进行差错订正处理,被赋于差错订正处理结果后被送给DRAM存取部。而后由DRAM存取部以页面方式对DRAM进行存取操作并加以存储。$#!
搜索关键词: 数据 存储 装置
【主权项】:
1.数据存储装置,包括:第一差错订正装置,用于接收作为差错订正代码的一个处理单位并且具有数据部分和用于差错订正的奇偶校验部分的数据块,相对于接收到的数据块执行差错订正处理,将作为差错订正处理的结果得到的数据的可靠性信息赋予经过了差错订正处理的数据块,再输出一个数据块;用于存储所述第一差错订正装置输出的数据块的随机存取存储器RAM,所述RAM具有二维矩阵地址空间并以行地址为单位进行存取;行地址存取装置,相对于所述第一差错订正装置输出的数据块生成所述RAM上设定的数据块存储区的行地址对RAM进行存取处理;列地址初始值生成装置,相对于所述第一差错订正装置输出的数据块生成由所述行地址存取装置存取的RAM行地址上的数据块存储区的列地址初始值;连续列地址存取装置,根据所述列地址初始值生成所述数据块存储区的连续列地址,从而对所述数据块存储区进行数据块的读出或写入的存取操作。
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