[发明专利]匹配滤波器无效
| 申请号： | 96112567.5 | 申请日： | 1996-09-18 |
| 公开（公告）号： | CN1100385C | 公开（公告）日： | 2003-01-29 |
| 发明（设计）人： | 寿国梁;周长明;山本诚;高取直 | 申请（专利权）人： | 株式会社鹰山;夏普株式会社 |
| 主分类号： | H03H11/04 | 分类号： | H03H11/04;H03H17/02 |
| 代理公司： | 中国国际贸易促进委员会专利商标事务所 | 代理人： | 杜日新 |
| 地址： | 日本*** | 国省代码： | 暂无信息 |
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| 摘要： | 本发明目的是提供一种既可确保运算速度又可执行整个电路刷新的匹配滤波器，其构成为增加地设有可以保持应在主采样保持电路中保持的模拟输入电压的一部分的多个辅助采样保持电路、由与加减运算电路等效的电路构成的第2加减运算电路、择一地输出加减运算电路或第2加减运算电路二者中一方输出的多路复用器，由此，设置可使主采样保持电路内的采样保持电路或加减运算电路停歇的期间并在该期间中进行刷新。 | ||
| 搜索关键词： | 匹配滤波器 | ||
【主权项】：
1.一种匹配滤波器，包括：主采样保持电路(SHm)，它具有保持时间序列的模拟输入电压且对应PN代码的值作为不同路径的输出而输出暂时所保持的模拟输入电压的多个单元采样保持电路(SH1～SH32、SH1～SH32、SH1～SH32、SH1～SH32)；以及第1加减运算电路(ADD1)，包括有，对这些单元采样保持电路的输出之中与PN代码的“1”相对应的路径的输出进行加法运算的第1加法运算器(ADD33-1、ADD32-1～ADD32-3)，对在单元采样保持电路的输出中与PN代码的“0”相对应的路径的输出进行加法运算的第2加法运算器(ADD33-2、ADD32-4～ADD32-6)，和从第1加法运算器的输出中减去第2加法运算器的输出的减法运算器(SUB9)；特征在于还设置有：可把在上述多个单元采样保持电路中应该采样并予以保持的模拟输入电压的一部分采样并予以保持的多个辅助采样保持电路(SHa、SHb)；由与上述第1加减运算电路等效的电路构成的第2加减运算电路(ADD2)；择一地输出上述第1加减运算电路或第2加减运算电路中一方输出的多路复用器(MUXo)、刷新已被辅助采样保持电路代替的单元采样保持电路，以及刷新未被多路复用器选中的上述第1加减运算电路或者第2加减运算电路的刷新装置(SWH42、SWA4、SWA10、SWA11、SWA121、SWA122)；上述单元采样保持电路和辅助采样保持电路的输出被输入到加减运算电路和第2加减运算电路两者。
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