[发明专利]一种共享存储式ATM交换网络无效
| 申请号： | 96119124.4 | 申请日： | 1996-08-02 |
| 公开（公告）号： | CN1052597C | 公开（公告）日： | 2000-05-17 |
| 发明（设计）人： | 周代琪 | 申请（专利权）人： | 深圳市华为技术有限公司 |
| 主分类号： | H04L12/56 | 分类号： | H04L12/56 |
| 代理公司： | 暂无信息 | 代理人： | 暂无信息 |
| 地址： | 518057 广东*** | 国省代码： | 广东;44 |
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| 摘要： | 一种共享存储式ＡＴＭ交换网络。包括信元头识别器（２０７），空闲地址存储器（２０３），输出端口地址队列存储器（２０４），主存储器（２０２），还包括用于删除重地址的标注寄存器（２１０），逻辑电路（２０６），补回丢失地址的判别寄存器（２０５）和地址产生器（２０８），以便及时修正和自动恢复地址链的任何出错，从而确保系统可靠性。 | ||
| 搜索关键词： | 一种 共享 存储 atm 交换 网络 | ||
【主权项】：
1、一种共享存储式ATM交换网络，该网络包括信元流变换器(201)，用于存储信元的主存储器(202)，各信元输出队列所共享的空闲地址存储器(203)和输出端口地址队列存储器(204)，信元头识别器(207)，信元流反变换器(209)，其特征在于：还包括标注寄存器(210)、控制逻辑电路(206)、判别寄存器(205)和地址产生器(208)；所述空闲地址存储器(203)的地址输出线同时与主存储器(202)、标注寄存器(210)、判别寄存器(205)和输出端口地址队列存储器(204)的输入端相连；所述输出端口地址队列存储器(204)的地址输出线在与主存储器(202)、控制逻辑电路(206)相连的同时，与所述标注寄存器(210)连接，使输出端口地址队列存储器(204)输出的地址(OAA)作为标注寄存器(210)的读地址(RDS)；所述标注寄存器(210)、判别寄存器(205)和地址产生器(208)的输出经控制逻辑电路(206)对空闲地址存储器(203)的地址存储进行控制。
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