[发明专利]锁相环电路无效
| 申请号： | 97104247.0 | 申请日： | 1997-05-07 |
| 公开（公告）号： | CN1064198C | 公开（公告）日： | 2001-04-04 |
| 发明（设计）人： | 李容源 | 申请（专利权）人： | LG半导体株式会社 |
| 主分类号： | H03L7/10 | 分类号： | H03L7/10;H03L7/189 |
| 代理公司： | 中原信达知识产权代理有限责任公司 | 代理人： | 余朦 |
| 地址： | 韩国忠*** | 国省代码： | 暂无信息 |
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| 摘要： | 一种锁相环（ＰＬＬ）电路，形成一闭环，并且包含一频率／相位检测器，一环路滤波器，和一电压控制振荡器，另外还包括电压控制振荡器控制器，该电路实现了快速频率锁定并且能够输出各种各样的频率。$＃! | ||
| 搜索关键词： | 锁相环 电路 | ||
【主权项】：
1.一种锁相环(PLL)电路，其特征在于，包括：一频率/相位检测器，用于接收一从外部输入的输入信号和一电压控制振荡器的输出信号，并且输出频率/相位的差值信号，它是通过将所述输入信号的频率/相位与所述输出信号的频率/相位进行比较而获得的；一环路滤波器，用于对所述频率/相位检测器的所述输出信号进行滤波；一电压控制振荡器控制器，用于依据一频道频率接收多个具有N位的频道数据，通过对所述频道数据进行转换产生一预定电平信号，将如此产生的信号与从所述环路滤波器中输出的一输出信号进行比较，并且当所述被产生的信号与从所述环路滤波器中输出的所述输出信号的电平相一致时，输出从所述环路滤波器中输出的所述输出信号，以及当所述被产生信号与从所述环路滤波器中输出的所述输出信号的电平不一致时，输出所述被产生的信号；和一电压控制振荡器，用于接收从所述电压控制振荡器控制器中输出的所述输出信号，并因此而输出一具有一频率的信号，其中，所述频率/相位检测器，所述环路滤波器，所述电压控制振荡器控制器，以及所述电压控制振荡器连接于一闭环中。
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