[发明专利]用于高级微处理器的门控存储缓冲器有效
| 申请号： | 97180942.9 | 申请日： | 1997-12-12 |
| 公开（公告）号： | CN1103079C | 公开（公告）日： | 2003-03-12 |
| 发明（设计）人： | M·J·温;G·P·得索萨 | 申请（专利权）人： | 全斯美达有限公司 |
| 主分类号： | G06F11/00 | 分类号： | G06F11/00 |
| 代理公司： | 上海专利商标事务所 | 代理人： | 李湘 |
| 地址： | 美国加利*** | 国省代码： | 暂无信息 |
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| 摘要： | 一种门控存储缓冲器，包含按照顺序暂时存储除其它存储器内容以外所有在主处理器将目标指令序列翻译为主指令的翻译期间产生的存储器内容的装置；如果执行翻译时未发生意外事件则按照顺序将翻译期间产生的存储器内容转移至存储器的装置；指示最近的向同一存储器地址存储的存储器内容以响应对存储器地址的访问的装置；以及如果执行翻译时未发生意外事件则按照顺序消除翻译期间产生的存储器内容的装置。 | ||
| 搜索关键词： | 用于 高级 微处理器 门控 存储 缓冲器 | ||
【主权项】：
1.一种对处理器指令序列执行期间产生的数据存储在存储器中进行控制的缓冲器，其特征在于，它包含：多个存储单元，每个能够保存寻址至存储器的数据和数据地址；当产生数据时将处理器操作产生的数据转移至存储单元直到指令序列完成执行为止的装置；识别缓冲器内由未完成执行指令序列产生的数据的装置；检测缓冲器内指向特定存储器地址的最近数据以响应存储器访问的装置；在产生存储内容的指令序列执行完成而未产生意外事件或错误之后将存储单元内的数据转移至存储器的装置；以及当产生存储内容的指令序列执行时产生意外事件或错误时消除存储单元内的数据的装置。
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