[发明专利]具有单一外存储器的数据多路复用装置无效

专利信息
申请号: 98120650.6 申请日: 1998-09-22
公开(公告)号: CN1166216C 公开(公告)日: 2004-09-08
发明(设计)人: 林直哉 申请(专利权)人: 恩益禧电子股份有限公司
主分类号: H04N7/52 分类号: H04N7/52;H04J3/16
代理公司: 中国专利代理(香港)有限公司 代理人: 王忠忠;张志醒
地址: 日本神奈*** 国省代码: 日本;JP
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摘要: 在数据多路复用装置中,单一外存储器存储不同种类传输数据。首部超高速缓冲存储器存储系统首部和首部数据,多个数据超高速缓冲存储器存储传输数据。超高速缓冲存储器经内部总线接至外存储器。数据输入电路在时分基础上从外存储器中顺序获取传输数据,将传输数据存入数据超高速缓冲存储器之一。系统时钟信号生成电路不断生成表示当前时间的系统时钟信号。选择电路顺序选择超高速缓冲存储器,产生系统首部、首部数据和传输数据形成的系统流。
搜索关键词: 具有 单一 外存 数据 多路复用 装置
【主权项】:
1.一种数据多路复用装置,包括:一内部总线(157);一单一外存储器(18),其连接至所述内部总线,用来存储音频流和视频流;一首部超高速缓冲存储器(161),用来存储一系统首部、一音频首部和一视频首部;一音频流超高速缓冲存储器(159),其连接至所述内部总线,用来存储音频流;一视频流超高速缓冲存储器(160),其连接至所述内部总线,用来存储视频流;一地址生成电路(153),其连接至所述外存储器,用来在一时分基础上按顺序获取所述音频流和所述视频流,以便将所述音频流和所述视频流分别存入所述音频流超高速缓冲存储器和所述视频流超高速缓冲存储器;一总线判优电路(158),其连接至所述地址生成电路,用来控制所述地址生成电路,以进行对所述内部总线访问竞争的判优;一系统时钟计数器(156),用来不断产生一表示当前时间的系统时钟信号;一选择电路(154),其连接至所述首部超高速缓冲存储器、所述音频流超高速缓冲存储器、所述视频流超高速缓冲存储器和所述系统时钟计数器,用来按顺序选择所述首部超高速缓冲存储器、所述音频流超高速缓冲存储器和所述视频流超高速缓冲存储器,并生成由所述系统首部、所述音频首部、所述视频首部、所述音频流和所述视频流形成的一系统流;和一控制电路(152),其连接至所述总线判优电路和所述选择电路,用于控制所述选择电路来选择所述系统时钟计数器,用以将所述系统时钟信号输入所述系统首部的一个预定位置。
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