[发明专利]时钟发生电路以及时钟发生方法无效

专利信息
申请号: 98122824.0 申请日: 1998-10-29
公开(公告)号: CN1126254C 公开(公告)日: 2003-10-29
发明(设计)人: 清水一祯;石见幸一;泽井克典 申请(专利权)人: 三菱电机株式会社
主分类号: H03L7/06 分类号: H03L7/06
代理公司: 中国专利代理(香港)有限公司 代理人: 叶恺东,王岳
地址: 暂无信息 国省代码: 暂无信息
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摘要: 时钟发生电路,备有:倍增装置(11),相位同步装置(12),分频装置(13)。时钟发生方法,具有以下步骤:a.使输入时钟频率倍增,发生倍增时钟;b.检测所述时钟和分频时钟之间的相位差,只是以对应所述相位差的分量使所述倍增时钟的相位延迟,发生相位与所述输入时钟相位一致的相位同步时钟;c.在所述相位同步时钟内,在每个固定周期检测特定的脉冲,以其脉冲为基准使所述相位同步时钟分频,发生所述分频时钟。不增加延迟元件等,能产生倍增数小的PLL输出,降低时钟输出频率。
搜索关键词: 时钟 发生 电路 以及 方法
【主权项】:
1.一种时钟发生电路,其特征是,备有:倍增装置,使输入时钟频率倍增,发生倍增时钟;相位同步装置,检测所述输入时钟和分频时钟之间的相位差,只是以对应于所述相位差的分量使由所述倍增装置发生的倍增时钟的相位延迟,发生相位与所述输入时钟相位一致的相位同步时钟;分频装置,在所述相位同步时钟内,在每个固定周期检测特定的脉冲,以其脉冲为基准使所述相位同步时钟分频,发生所述分频时钟。
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