[发明专利]非对称数字用户线路接口系统无效

专利信息
申请号: 98126704.1 申请日: 1998-12-30
公开(公告)号: CN1159883C 公开(公告)日: 2004-07-28
发明(设计)人: 金洪成 申请(专利权)人: LG情报通信株式会社
主分类号: H04L12/56 分类号: H04L12/56;H04L29/10
代理公司: 中原信达知识产权代理有限责任公司 代理人: 余朦
地址: 韩国*** 国省代码: 韩国;KR
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摘要: 发明提供了一种ATM交换机中的ADSL接口系统,用于使ADSL用户连接至ATM交换机,其包括:一CPU及外围电路部分,它能从用户端接收信号并能识别一待进行同步处理的指定值;一上行单元处理部分,它能将从用户端接收到的信号转换为ATM单元并将其发送至用户控制系统;以及一下行单元处理部分,它能将从用户控制系统接收到的信号转换为传输信号并将其发送到用户端。
搜索关键词: 对称 数字 用户 线路 接口 系统
【主权项】:
1.一种ATM交换机的ADSL接口系统,其包括:控制器,其从用户端接收用户单元信号,将用户单元信号转换成ATM单元,并且输出所述ATM单元;上行单元处理器,其将从所述控制器输出的ATM单元转换成被发送到用户控制系统的信号;下行单元处理器,其将从所述用户控制系统接收到的信号转换为传输信号并将其发送到所述用户端,其中,所述上行单元处理器包括:接收机,其将从所述用户端接收到的用户单元信号转换为TTL电平信号并将其加载至所述控制器;FIFO,其保存从所述控制器输出的ATM单元;上行控制部分,其读出保存在所述FIFO中的ATM单元,并将所述ATM单元转换成并行数据;并行FIFO,其保存从所述上行控制部分输出的并行数据;和第一缓冲器,其累加从所述并行FIFO输出的并行数据,并且根据所述累加的数据输出将被发送到所述用户控制系统的信号;和其中,所述下行单元处理部分包括:第二缓冲器,其保存从所述用户控制系统接收到的信号;下行控制部分,其读出从保存在第二缓冲器之中的信号导出的数据,并将它们转换为串行数据;串行FIFO,其保存从所述下行控制部分输出的串行数据;单元插入部分,其从所述串行FIFO中读出所述串行数据并将所述串行数据插入到一E1帧;和调帧器,其将被插入到所述E1帧中的串行数据转换成E1信号,并将所述E1信号发送至所述用户端。
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