[发明专利]卫星无线导航系统的伪噪声信号接收机无效
申请号: | 98813024.6 | 申请日: | 1998-11-11 |
公开(公告)号: | CN1285980A | 公开(公告)日: | 2001-02-28 |
发明(设计)人: | 安德烈·L·罗格;博里斯·D·费多托夫;弗拉迪米尔·N·伊万诺夫;亚历山大·N·科罗特科夫;维克特·I·马拉欣;瑟盖·B·皮萨雷夫;丹尼斯·G·波维雷尼;艾琳娜·E·加里奇娜;米凯尔·P·索欣;博里斯·V·谢博谢维奇;瓦谢斯拉夫·S·尼库林;奥利格·D·奥西波夫;米凯尔·J·西林;亚那托利·N·索尔达坦科夫;郑都炫;李英灿 | 申请(专利权)人: | 三星电子株式会社 |
主分类号: | H04B7/185 | 分类号: | H04B7/185;G01S5/14 |
代理公司: | 柳沈知识产权律师事务所 | 代理人: | 黄小临 |
地址: | 韩国*** | 国省代码: | 暂无信息 |
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摘要: | 用于使用GLONASS和GPS系统信号确定坐标和时间的卫星无线导航系统的伪噪声信号接收机。射频转换器的信号和时钟输出端分别连接到N信道数字相关器的第一和第二信号和时钟输入端,射频转换器中的信号第二频率转换的每个信道中的混频器的输出端通过串联的控制增益放大器和阈值设备连接到该信道的输出端,信号第二频率转换的第二信道的混频器的参考输入端连接到用于产生时钟信号和外差频率的设备的第二外差频率的信号输出端;用于分频的第一和第二单元与该设备串联。减小了整个尺寸并且不出现如数字化器之类的复杂部件。 | ||
搜索关键词: | 卫星 无线 导航系统 噪声 信号 接收机 | ||
【主权项】:
1.一种卫星无线导航系统的伪噪声信号接收机,包括串联的天线和射频转换器,相互连接的N信道数字相关器和处理器,射频转换器包括一个连接到天线的输入单元并包括至少一个连接到输入单元的输出端的带通滤波器,信号第一频率转换单元包括至少一个放大器和一个连接到信号第一频率转换单元的输出端,分别连接到卫星无线导航系统SNRSGPS或GLONASS的信号第二频率转换的第一和第二信道的混频器,每个信道包括串联的滤波器和混频器,并且还包括产生第一外差频率的信号的单元,产生时钟信号和外差频率的设备,由产生第一外差频率信号的单元的输出端形成的第一外差频率信号的输出端连接到信号第一频率转换单元的混频器的参考输入端,而第二外差频率的信号输出端连接到信号第二频率转换的第一信道的混频器的参考输入端;信号第二频率转换的第一和第二信道的输出端以及产生时钟信号和外差频率的设备的时钟信号输出端形成射频转换器的信号和时钟输出端;在N信道数字相关器中,其信道中的每一个包括其第一和第二输入端连接到N信道数字相关器的第一和第二信号输入端的输入信号转换开关,数据交换单元通过相应的数据总线连接到所述处理器以及第一、第二、第三和第四存储单元的输出端,数字载波发生器的控制输入端,控制寄存器的控制输入端,数字码发生器的控制输入端和参考C/A码发生器的第一输入端;存储单元的时钟输入端,数字码发生器,数字载波发生器和可编程延迟线连接到N信道数字相关器的时钟输入端;输入信号转换开关的输出端连接到同相和正交相关处理信道的数字混频器的第一输入端,同相和正交相关处理信道的第二输入端分别连接到数字载波发生器的"cosine"和"sine"输出端,而输出端连接到第一和第二相关器的互连的第一输入端之间的结点以及第三和第四相关器的互连的第一输入端之间的结点,第一、第二、第三和第四相关器的输出端分别连接到第一、第二、第三和第四存储单元的信号输入端;第一和第四相关器的第二输入端连接到可编程延迟线的参考C/A码的精确"P"复制的输出端,可编程延迟线的第一输入端连接到参考C/A码发生器的输出端,参考C/A码发生器的第二输入端连接到数字码发生器的输出端;可编程延迟线的第二输入端和参考C/A码发生器的第三输入端分别连接到控制寄存器的第一和第二输出端,控制寄存器的第三输出端连接到输入信号交换器的第三输入端,其特征在于:射频转换器的信号和时钟输出端分别连接到N信道数字相关器的第一和第二信号和时钟输入端;在信号第二频率转换的每个信道中的射频转换器中,混频器输出端通过以串联控制两比特电平控制量化器形式制成的控制增益放大器和阈值设备连接到信道输出端;信号第二频率转换的第二信道混频器的参考输入端连接到产生时钟信号和外差频率的设备的第二外差频率的信号输出端,其中产生第一外差频率信号的单元的输出端连接到将该频率除8的第一和第二单元,第一和第二单元的输出端分别形成第二外差频率的信号输出端和时钟速率的信号输出端;N信道数字相关器的每个信道的另外设置有第五和第六存储单元,第五和第六存储单元的输出端通过相应的数据总线连接到数据交换单元,时钟输入端连接到N信道数字相关器的时钟输入端,第五和第六相关器的输出端分别连接到第五和第六存储单元的信号输入端;延迟选通脉冲整形器、键控门(key)和加法器的第一输入端连接到可编程延迟线的参考C/A码的差值"E-L"或超前"E"复制的输出端,第二输入端连接到键控门(key)的输出端,而输出端连接到第二和第三相关器的第二输入端;第五和第六相关器的第一输入端分别连接到第一和第二混频器的输出端;延迟选通脉冲整形器的输出端连接到第五和第六相关器的第二输入端和键控门(key)的信号输入端,键控门(key)的控制输入端连接到控制寄存器的第四输出端;延迟选通脉冲整形器的第一输入端连接到可编程延迟线的参考C/A码的精确"P"复制的输出端,而其第二输入端连接到数字码发生器的输出端。
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