[发明专利]半导体存储器无效
申请号: | 99102722.1 | 申请日: | 1999-03-04 |
公开(公告)号: | CN1136583C | 公开(公告)日: | 2004-01-28 |
发明(设计)人: | 土屋智裕 | 申请(专利权)人: | 日本电气株式会社 |
主分类号: | G11C29/00 | 分类号: | G11C29/00 |
代理公司: | 中原信达知识产权代理有限责任公司 | 代理人: | 穆德骏;余朦 |
地址: | 日本*** | 国省代码: | 日本;JP |
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摘要: | 一种半导体器件,包括具有标准单元阵列和冗余单元阵列的块。R/N转接设置电路包括串联的多个晶体管。冗余确定电路接收一个地址,并确定是否采用冗余单元阵列。若采用冗余确定电路不仅输出有效YPR信号,而且输出故障单元阵列的目前列方向位置。该位置信息通过冗余位置译码器提供给转接设置电路。转接设置电路产生转接信号DSW,并输出给R/N转接电路。转接电路将输入/输出部分的I/O线转接到所选标准单元阵列和冗余单元阵列。 | ||
搜索关键词: | 半导体 存储器 | ||
【主权项】:
1.半导体存储器件,包括:多个标准单元阵列,每个阵列包括多个存储单元;至少一个冗余单元阵列,包括多个存储单元;多个存储块,每个存储块包括多个标准单元阵列和至少一个冗余单元阵列;冗余确定电路,包括多个熔丝单元,每个熔丝单元存储冗余选择信息和故障位置信息,冗余选择信息表示是否用冗余单元阵列取代存储块内的标准单元阵列,故障位置信息表示将被冗余单元阵列旁路的标准单元阵列的位置;转接设置电路,具有多个设置电路,每个设置电路具有设置于第一端子和相关的第二端子间的第一转接电路,所选设置电路的第一端子耦连到相邻设置电路的第二端子,至少一个第一端子是耦连到第二逻辑电平的最低端,至少一个第二端子是耦连到冗余选择信息输出端的最高端,第一转接电路响应故障位置信息构成它们的第一端子和有关第二端子间的导电通路或不导电通路,各设置电路的第二端子提供转接信号;及转接电路,用于根据从转接设置电路来的转接信号输出选择至少两个位线中的一个,并将所选位线连接到输入/输出部分。
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