[发明专利]信息处理设备无效
| 申请号： | 99105245.5 | 申请日： | 1999-04-22 |
| 公开（公告）号： | CN1125403C | 公开（公告）日： | 2003-10-22 |
| 发明（设计）人： | 鹤田彻;野村祐司 | 申请（专利权）人： | 富士通株式会社 |
| 主分类号： | G06F13/00 | 分类号： | G06F13/00;G06F12/00 |
| 代理公司： | 中国国际贸易促进委员会专利商标事务所 | 代理人： | 于静 |
| 地址： | 暂无信息 | 国省代码： | 暂无信息 |
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| 摘要： | 一种信息处理设备构造成包括一个判断部分和一个控制部分，判断部分用于译码输入请求的地址和输出指明输入请求是超高速缓存控制请求还是DMA控制请求的判断信号，控制部分用于当来自判断部分的判断信号指明超高速缓存控制请求时执行超高速缓存控制，当判断信号指明DMA控制请求时执行DMA控制。 | ||
| 搜索关键词： | 信息处理 设备 | ||
【主权项】：
1.一种信息处理设备，包括：判断装置，用于译码输入请求的地址并且输出指明所述输入请求是超高速缓存控制请求还是DMA控制请求的判断信号；控制装置，通过可变地设置第一区和第二区的比率X∶Y，用于当来自所述判断装置的判断信号指明超高速缓存控制请求时执行超高速缓存控制，并且当判断信号指明DMA控制请求时执行DMA控制，其中X和Y均大于零；和存储装置，包括第一区和第二区，第一区组成用于超高速缓存控制的超高速缓冲存储器部分，第二区组成用于DMA控制的数据存储器部分，其特征在于，所述控制装置根据由2n描述的一个超高速缓存指数可变地设置比率X∶Y，其中n是可变的整数。
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