[发明专利]半导体存储器件的制造方法及其结构有效
申请号: | 99109414.X | 申请日: | 1999-06-29 |
公开(公告)号: | CN1119834C | 公开(公告)日: | 2003-08-27 |
发明(设计)人: | 梁元硕 | 申请(专利权)人: | 三星电子株式会社 |
主分类号: | H01L27/108 | 分类号: | H01L27/108;H01L21/8242;H01L21/768 |
代理公司: | 中原信达知识产权代理有限责任公司 | 代理人: | 谢丽娜,余朦 |
地址: | 暂无信息 | 国省代码: | 暂无信息 |
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摘要: | 一种制造半导体器件的方法。在绝缘层上形成材料层图形。在材料层图形上淀积另一个绝缘层。在另一个绝缘层上形成沟槽掩模图形。利用该掩模,在另一个绝缘层处进行腐蚀并中止在材料层,从而形成第一开口。利用材料层图形,腐蚀绝缘层的露出部分,形成与第一开口对准的第二开口,并由此形成用于金属线的双镶嵌开口。在第一和第二开口中淀积金属,形成双镶嵌金属线。 | ||
搜索关键词: | 半导体 存储 器件 制造 方法 及其 结构 | ||
【主权项】:
1.一种制造半导体器件的方法,所述方法包括下列步骤:在半导体衬底上形成器件隔离区以限定有源区,所述半导体衬底有单元阵列区域和周边区域;在所述衬底上形成第一绝缘层;在所述第一绝缘层上形成材料层图形,所述材料层图形有第一开口部分,第一开口部分分别在所述单元阵列区域限定用于存储节点的接触孔,在所述周边区域限定用于金属互连的接触孔;在所述材料层图形上形成第二绝缘层;在所述第二绝缘层上形成沟槽掩模图形,所述沟槽图形在所述周边区域有至少在所述材料层图形的所述第一开口部分上对准的第二开口部分,所述第二开口部分大于所述第一开口部分;用所述沟槽掩模作腐蚀掩模,腐蚀所述第二绝缘层并在所述材料层图形处中止,形成第一触点开口,并利用至少一个所述第一触点开口腐蚀第一绝缘层的露出部分,在所述周边区域形成与所述第一触点开口的至少一个自对准的至少一个第二触点开口;和用导电材料填充所述第一和第二触点开口,分别形成形成于第一和第二触点开口中的第一金属互连,和形成于第一开口中的第二金属互连。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的
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