[发明专利]高隐蔽性键码控电子锁无效
申请号: | 00102997.5 | 申请日: | 2000-03-14 |
公开(公告)号: | CN1313445A | 公开(公告)日: | 2001-09-19 |
发明(设计)人: | 陈保禄 | 申请(专利权)人: | 陈保禄 |
主分类号: | E05B49/04 | 分类号: | E05B49/04 |
代理公司: | 暂无信息 | 代理人: | 暂无信息 |
地址: | 100044 北京*** | 国省代码: | 北京;11 |
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摘要: | |||
搜索关键词: | 隐蔽 性键码控 电子锁 | ||
1、一种高隐蔽性键码控电子锁,包括锁体,电源,其特征在于:它还包括,彩色键盘,键码拾取记忆逻辑,脉冲键控逻辑,键控总清逻辑,键码锁存及译码逻辑,密码设置总线逻辑,伪随机码控制逻辑,综合控制逻辑,其中键码拾取记忆逻辑分别和彩色键盘,脉冲键控逻辑,键控总清逻辑,键码锁存及译码逻辑及伪随机码控制逻辑相连,电源逻辑连脉冲键控逻辑,将电源加到各路中,键控总清逻辑又分别与伪随机码控制逻辑和键码锁存及译码逻辑相连,密码设置总线逻辑分别与键码锁存及译码逻辑、综合控制逻辑相连,综合逻辑和锁体相连。
2、根据权利要求1所述的电子锁,其特征在于:所述的彩色键盘是由四色四排,每排四只键组成,采用4×4四色独立式小键盘结构,每只键只对应一个逻辑输入口线,键体的下面接点均连接+15V,上面每排4键的接点分别连到键码,拾取记忆逻辑电路中的键码锁存器中。
3、根据权利要求1所述的电子锁,其特征在于:键码拾取记忆逻辑均由四组以双四位锁存器的输出,通过四个反馈二极管反馈到四位锁存器的输入端组成的;所述的键码锁存及译码逻辑电路由四组全同的4位锁存/4-16译码器(IC9-IC12)组成,四个输入端(D1~D4)分别接到四个对应的拾取和记忆逻辑电路(IC4:A,B,IC6:A,B)的对应输出端(Q0~Q3),输入4位二进制码可译码16个输出,四个锁存译码器则有四个对应的逻辑输出。通过译码电路把四色键入码,译码成四个16选1逻辑输出接到后续的译码总线(A1-A4)上。
4、根据权利要求1所述的电子锁,其特征在于:所述密码设置总线逻辑电路是将前面四个锁存译码电路(IC9-IC12)译码输出通过短路跳线将其对应的四个16选1译码逻辑1连到各自译码总线(A1-A4),由总线(A1-A4),连到后续的四个输入与门(IC13:A)的四个输入端。
5、根据权利要求1所述的电子锁,其特征在于:所述的脉冲键控逻辑电路由比较器构成两个脉冲发生器(IC1:A,B),连由二输入与门构成的四个脉冲控制门(IC3:A,B,C,D),连由四输入或门构成的四个脉冲启动门(IC2:A,B和IC5:A,B)而四组电路结构相同,两组共用一个脉冲发生器各连二个后续电路,即:
一个比较器的“+”输入端分别连接三个电阻。两个电阻为电压分压器,一个电阻另端连+15V,另个电阻一端接地,还有一个电阻另端分别接两个二输入与门的输入端,比较器的输出端,连二个电阻,其中一个电阻另端连+15V,另一个电阻的一端接电容,比较器“-”输入端,而电容另端接地,二输入与门另一个输入端连四输入或门输出端,而其四个输入分别连连接器和四个电阻,四个电阻另端均接地。
6、根据权利要求1所述的电子锁,其特征在于:所述的键控总清逻辑是将总清总线均连到各自的二输入或门上;所述的伪随机码控制逻辑是以比较器(IC1:C)为主体构成低频脉冲发生器,比较器“+”输入端连分压器和一个电阻,一个电阻另端连15V,一个电阻另端连电容接地,另一个电阻另端连比较器输出和二个电阻,一个电阻另端连电容另端连比较器“-”端,一个电阻另端连15V,比较器的输出端还连二输入与门一输入端。二输入与门的输出端连12位二进位计数器(IC16)脉冲端,此计数器又连四输入或非门(IC17:A),其输出连二输入总控与门(IC7:B)组成,C4为去耦电容,一端连+15V另端接地,低频脉冲振荡频率远低于脉冲键控频率。
7、根据权利要求1所述的电子锁,其特征在于:所述的综合控制逻辑电路是由四输入与门(IC13:A)输出连二输入与门(IC7:B)输入,其输出端连二输入或门(IC15:A)其输出连射极跟随器(T1)基极,其发射极连二极管负端其正端接地,发射极还连电阻和锁体控制线圈连接器,电阻另端也接上述连接器;二输入或门(IC15:A)另一输入端连室内开锁电路的二极管负极,一个电阻和一个电容“+”端,电容另端接地,电阻另端接二极管正端;二输入或门(IC15:B)的输入端,连一个电阻,及连接器(B2B),连接器另端接+15V,后者电阻另端接地。
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