[发明专利]封锁计算机输入/出通信端口的方法和装置无效
申请号: | 00114162.7 | 申请日: | 2000-03-29 |
公开(公告)号: | CN1315694A | 公开(公告)日: | 2001-10-03 |
发明(设计)人: | 苏毅 | 申请(专利权)人: | 苏毅 |
主分类号: | G06F12/10 | 分类号: | G06F12/10 |
代理公司: | 深圳市顺天达专利商标代理有限公司 | 代理人: | 郭伟刚 |
地址: | 518010 广东省深*** | 国省代码: | 广东;44 |
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摘要: | |||
搜索关键词: | 封锁 计算机 输入 通信 端口 方法 装置 | ||
本发明涉及计算机安全技术领域,具体地说,涉及一种封锁计算机输入/出通信端口的方法和装置。
禁用计算机外设的传统做法是通过物理方法将有关插卡从计算机上拔下来,或将外接通讯设备从通信接口上拔下来,这种做法的缺点是手工操作,效率低,难以有效抵御可能威胁计算机安全的I/O端口的非法通信。
本发明的目的是提供一种封锁计算机输入/出通信端口的方法,这种方法可以通过软件控制或硬件判别电路的方法对硬件I/O端口是否禁用进行有效、高效的控制,从而改善计算机数据尤其是在网络环境下的计算机的安全性。
本发明的目的是提供一种封锁计算机输入/出通信端口的装置,这种装置可以与软件或相关硬件电路相配合,在任何时候可以根据需要对需要禁用的计算机输入、输出端口进行控制,使之不能接收或输出数据,从而改善计算机系统安全性。
本发明的目的是这样实现的,构造一种封锁计算机输入/出通信 端口的方法,包括以下步骤:
根据禁用命令确定需要禁用的输入/出口地址;
通过地址检测电路检测当前地址,如果当前地址与需要禁用是输 入/出口地址相同,则在I/O读信号或I/O写信号有效时,在数据总线上输出一个干扰信号,该干扰信号可以是全“1”、全“0”或其它固定信号,也可以是随机产生的信号。
按照本发明提供的方法,其特征在于,还包括将禁用命令存储在可受其它软件访问或硬件电路控制的存储装置中的步骤。
按照本发明提供的方法,其特征在于,所述地址检测电路可以是一个可编程逻辑阵列。
本发明的另一目的是这样实现的,构造一种封锁计算机输入/出通信端口的装置,包括:
用于存储禁用地址的存储单元,
用于将所述存储单元中存储的禁用地址与地址总线上的当前地址进行比较的地址检测单元,
根据地址检测单元输出的检测结果,输出信号到数据总线上的执行单元,所述执行单元在检测单元检测出地址总线上当前地址与所述存储单元中禁用地址相同时,而且I/O读或I/O写信号为有效时,输出一个干扰信号到数据总线。
按照本发明提供的装置,其特征在于,所述干扰信号可以是全“1”、全“0”或其它固定信号或随机产生的信号。
按照本发明提供的装置,其特征在于,所述地址检测单元可以是其输入端连接地址总线的可编程逻辑阵列。
按照本发明提供的装置,其特征在于,所述存储单元可以是寄存器。
按照本发明提供的装置,其特征在于,所述执行单元可以是一个三态数据锁存器。
实施按照本发明提供的封锁计算机输入/出通信端口的方法和装置,使得可以根据安全方面的考虑,例如在与某一网络处于连接状态时,通过本发明提供的方法和装置禁止对输入/出端口的任何访问,从而确保输入/出口所对应的设备和资源不被非法访问,提高和改善网络的安全性能。
下面结合附图,对本发明的特点作进一步说明,附图中:
图1为实施本发明方法和装置的具体电路原理图。
如图所示,实施本发明提供的封锁计算机输入/出通信端口的电路图中,采用了U1、U2两个型号为G16V8的GAL,该可编程逻辑阵列的12个输入端与地址总线A[0。。11]连接,另有两个输入端分别连接I/O读和I/O写信号,有一个输出端与三态锁存器(U3,型号为74F573、也可以是具有同样功能的其他型号)的数据输出使能端(OC)连接,设计或预制两个GAL的内部逻辑可以在地址总线输入A[0-11]与需要禁止的地址相同而且I/O读或I/O写有效时输出信号到锁存器U3的信号输出使能端(OC),此时,平常为三态的数据输出端输出固定的全“1”或全“0”或其它固定信号或随机产生的信号到数据总线,使得I/O端口的读或写成为不可能。
本发明的方法和装置还可以其它方式实现。
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