[发明专利]数据通信系统的节点中多链路层到单个物理层的接口无效
申请号: | 00803216.5 | 申请日: | 2000-09-15 |
公开(公告)号: | CN1364264A | 公开(公告)日: | 2002-08-14 |
发明(设计)人: | S·巴纳杰;J·博尼特 | 申请(专利权)人: | 皇家菲利浦电子有限公司 |
主分类号: | G06F13/10 | 分类号: | G06F13/10;H04L29/06 |
代理公司: | 中国专利代理(香港)有限公司 | 代理人: | 程天正,傅康 |
地址: | 荷兰艾*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 数据通信 系统 节点 中多链路层到 单个 物理层 接口 | ||
1.一种数据通信系统(1),包含:
多个节点(2,3,4,5,6,7,8,9,10,11);
用于在所述的节点(2,3,4,5,6,7,8,9,10,11)间串行交换同步数据和异步数据的串行总线结构(12);
包含在所述的节点之一中的物理层接口电路(81),所述的物理层接口电路(81)包含与所述的串行总线结构(12)相耦合的外部端口(82,83,84)、内部并行数据接口(91)和控制接口(94);
包含在所述的一个节点中的多个链路层接口电路,每个所述的链路层接口包含另外的内部并行数据接口和另外的控制接口;
多个双向交换装置(88,89,90),在一侧所有的所述的双向交换装置(88,89,90)与所述的内部并行数据接口(91)相耦合,而在另一侧每个所述的双向交换装置与所述的另外的内部并行数据接口中相应的一个相耦合;以及
包含在所述的一个节点中的逻辑电路(93),所述的逻辑电路(93)被耦合在所述的物理层接口电路(81)的所述控制接口(94)和所述的多个链路层接口(85,86,87)的所述的另外控制接口之间,所述的逻辑电路(93)用于选择地将同步数据流和异步数据流从所述的链路层接口电路(85,86,87)路由到所述的物理层接口电路(81)和从所述的物理层接口电路(81)路由到所述的链路层接口电路(85,86,87)。
2.权利要求1的数据通信系统(1),其中所述的每个链路层接口电路(85)包含至少一个外部同步数据端口(116,117),用于耦合到那些在所述一个节点的外部的外部装置。
3.权利要求2的数据通信系统(1),其中所述的至少一个外部同步数据端口(116,117)在全双工模式下工作。
4.权利要求2的数据通信系统(1),其中所述的外部装置是数字音频或数字视频装置。
5.权利要求1的数据通信系统(1),其中所述的链路层接口电路(85,86,87)包含各自的配置寄存器(100,101,102),用于配置所述的链路层接口电路,以及包含外部主机接口(110),用于耦合一个主机控制装置(112),所述的主机控制装置(112)配置为通过提供存储在所述配置寄存器的路由控制信息来控制所述的选择的路由。
6.权利要求1的数据通信系统(1),其中所述的物理层接口电路(81)包含时钟发生装置,用于产生一个主时钟信号(60),所述的主时钟信号(60)控制着所述的同步和所述的异步数据流的主定时。
7.权利要求6的数据通信系统(1),其中在所述的主定时的一个周期内为所述的同步数据流保留保证时间部分(61)。
8.权利要求7的数据通信系统(1),其中如果当前的同步数据流需要的时间少于所述的保证时间部分,则用于异步数据流的时间部分动态增加,超过在所述的周期内的剩余的时间部分(62)。
9.权利要求5的数据通信系统(1),其中通过所述的配置寄存器(100,101,102),所述的异步数据流的比特速率可从100Mbit/s,200Mbit/s和400Mbit/s中选择。
10.权利要求1的数据通信系统(1),其包含一个请求节点,请求来自所述一个节点的业务,其中将所述的一个节点的其中一个所述的链路层接口电路(85,86,87)配置为主链路层接口电路,并存储一个在所述的系统(1)的所述节点中全局唯一的全局唯一标识符(106,107,108),而将所述一个节点的其它链路层接口电路配置为从属链路层接口电路,所述的主链路层接口电路配置为通过在一个响应消息中提供所述全局唯一标识符而对所述的请求节点作出响应。
11.权利要求10的数据通信系统(1),其中所述的主链路层接口电路配置为以偏移值存储自身和所述的从属链路层接口电路(101,102)的配置寄存器,以致于允许所述的请求节点通过所述的偏移值在所述的一个节点中寻址所述的链路层接口电路中预定的一个电路。
12.权利要求1的数据通信系统(1),其中对于流入所述的物理层接口电路方向的异步数据流的通信,所述的链路层接口电路(85,86,87)被配置为在所述的异步数据流中包括一个唯一标签(75),在所述的一个节点中唯一地识别链路层接口电路。
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