[发明专利]具有地址扰频的存储器阵列

说明书

本发明根据主权利要求的前序部分从存储器阵列开始。这种类型的存储器阵列是所有公用微型计算机的一部分，并在例如“Chip und System，”R.Zaks，SYBEX-Verlag，1984，pp.113ff中进行了描述。基本上，类似的微型计算机也用于安全相关的应用中，例如用于执行金融交易的智能卡。可是，在这些情况下，经常采取附加的措施以利用微型计算机防止对安全的攻击。这种措施的一个例子可在“Chipkarten，”Karlheinz Fietta，Huthig Verlag，1989，pp.68-72中看到。在其中描述的THOMSON的TS1834  芯片中，利用接口将地址总线和数据总线做成从外部不可见。另一个用于增加防止对微型计算机的篡改的措施可以在EP 694 846 A1中看到。这里提供了经数据总线传送的数据可能被扰频几次，使得即使有人成功地读取了数据，也不可能评价并因此利用它们

尽管公知的措施已经保证了高度的安全，考虑到与执行金融交易相关使用的微型计算机的安全的特殊重要性，还是期望进一步提高它们防止篡改的能力。本发明就是基于提供实现这个目的的进一步措施的问题。

这个问题通过具有独立权利要求1和7的技术特征的阵列和方法得到了解决。根据本发明，扰频装置处于微型计算机中出现的至少一个随机存取存储器之前，该扰频装置以不可预期的方式向经由地址总线传送的逻辑地址分配存储器中的单元，然后所述单元实际上被物理地占用。因此，本发明的存储器阵列提供了下列优点，即使通过分析随机存取存储器的存储单元的内容来利用微型计算机成为不可能。实现扰频装置所需要的逻辑需要极少的空间并且可以容易地包括在公用微型计算机构造中。最好是，对应于所定义的事件，定期地重复扰频。

下面参照附图更详细地说明本发明的示例。

附图说明了微型计算机的存储器阵列。

附图作为微型计算机的总体结构的细节说明了微型计算机的存储器阵列。标号11指明了一个随机存取存储器，即在通常情况下是易失性RAM，或者逐渐地还可以是非易失性RAM，其可以被分为多个寄存器存储体(bank)12。每个寄存器存储体12被依次分为有限数目的存储单元10，存储单元10在存储体12内的物理位置在所有情况下都由所分配的地址13清楚地指明。每个存储单元10存储一个字节的信息，寄存器存储体12常常包括8个存储单元10或其整数倍。

存储器11通过数据总线21与微控制器25相连。其基本功能是执行以通常的方式存储于最好是非易失性的存储器装置中的程序指令26、27、28。程序指令的执行包括存储器11的写入和读取访问。这里，数据总线21用于传输写入存储器11或从存储器11读出的数据内容。存储器11经由第二总线连接器19还与选择装置14相连。选择装置14将经由数据总线21传送的数据内容分配给存储单元10，数据内容被物理地存储于数据单元10或从其中读出。对于分配，选择装置14同样地经由第二总线，地址总线与微控制器25相连。对于每个数据内容，选择单元14由此以逻辑地址23的形式经由地址总线20获得关于将要存取哪一个存储单元10的信息。

选择装置14还包括扰频装置15。后者以不可预期的方式将存储器11中的地址13分配给经由地址总线20提供的逻辑地址23，然后，所述地址实际上被物理地存取，即写入或读出。该分配最好在任何时间是可重新定义的。为了触发再分配，扰频装置15经由控制线16与微控制器25相连。

下面将参照示例性指令序列说明上述阵列的功能模式。假设指令序列包括两个指令27、28(不必要是连续的)，第一个在寄存器R2中初始设置值“1”，第二个在后面的时间再次调用寄存器R2的内容以将其写入到被称作“结果寄存器”的寄存器中。

第一个指令27可以象征性地表示为“MOV R2，#1”；这里“MOV”代表将执行的移动(Move)功能，R2逻辑地指明存储器11中的存储单元10的地址，这里由“#”标记的值1是将设置的值。第二个指令28的对应的符号表示为“MOV erg，R2”；这里“MOV”再次指明移动(Move)功能，“erg”指明结果寄存器的逻辑地址23，R2指明将要读取的存储器11中的存储单元。假设指令序列27、28是程序的一部分，或包括未详细示出的指令序列29，该指令序列29总体上用来实现微处理器的功能或由微处理器控制的装置的功能。另外指令26处于指令序列29的前面，用于启动选择装置14中的扰频。所述指令可以被编程或根据触发事件由微控制器自动地形成。