[发明专利]无线基站装置和无线通信方法无效

专利信息
申请号: 01800082.7 申请日: 2001-01-12
公开(公告)号: CN1358373A 公开(公告)日: 2002-07-10
发明(设计)人: 宫和行;三好宪一;上杉充 申请(专利权)人: 松下电器产业株式会社
主分类号: H04J13/04 分类号: H04J13/04;H04B7/26
代理公司: 北京市柳沈律师事务所 代理人: 马莹
地址: 日本*** 国省代码: 暂无信息
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摘要:
搜索关键词: 无线 基站 装置 无线通信 方法
【说明书】:

技术领域

发明涉及数字无线通信系统中使用的无线基站装置和无线通信方法。

背景技术

作为CDMA(Code Division Mutiple Access:码分多址)系统中的干扰消除方式,有单用户型(SUD:Single User Detection)和多用户型(MUD:Multi UserDetection)。单用户型是仅用本台的扩频码和接收定时来进行干扰消除的方式,以正交滤波器为代表例,该滤波器自适应地控制匹配滤波器的抽头系数,使得对于干扰信号的扩频码进行正交。与MUD相比,SUD结构简单、实现性高,但难以应用于多路径环境中的码元周期和扩频码周期不一致的情况。

另一方面,MUD是根据进行通信的所有用户的扩频码、接收定时信息对所有用户的接收信号进行振幅、相位估计并进行数据判定、进行干扰消除的方式,没有扩频码造成的制约。作为MUD,有多级型干扰消除器和单级型干扰消除器,多级型干扰消除器通过根据信道估计值和判定数据在接收端生成其他用户的干扰复本信号,从接收信号中减去该复本信号,通过多次(多级)重复进行提高SIR(Signal to Interference Ratio:信号干扰比)的处理来改善接收特性,而单级型干扰消除器通过对所有信道的所有码元的似然进行排序处理,在接收端从似然高的码元起生成复本信号,并从接收信号中减去该复本信号,从而提高SIR,改善接收特性。

作为单级型干扰消除器,有上杉、加藤、本间等人在‘上行线路中的CDMA干扰消除器的研讨’((日本)信学技报IEICE RCS96-121)中提出的码元排序型干扰消除器(SRIC:Symbol Ranking Type Interference Canceller)。

用图1说明该码元排序型干扰消除器的工作。首先,对于各用户的接收信号的所有码元由匹配滤波器(MF)1用扩频码(通信终端装置的扩频调制处理中使用的扩频码)来进行解扩处理,将得到的解扩信号由RAKE合成电路2进行RAKE合成。然后,用临时判定电路3对RAKE合成后的各码元进行临时判定。由软判定缓冲器5存储临时判定过的各码元。软判定缓冲器5仅缓冲根据似然进行排序的时间幅度(窗口宽度:进行排序的码元范围)。

临时判定后的各码元被送至似然计算电路4,在那里进行似然计算。将计算了似然的所有码元送至排序电路6。排序电路6根据计算的似然从似然高的码元起进行排序。复本生成电路7从排序的所有码元中似然最高的码元起生成复本信号,将该复本信号输出到加法器9。加法器9求延迟电路8延迟的接收信号和复本信号之间的差分。即,从接收信号中消除与似然最高的码元所对应的复本信号。

这样,对消除了复本信号的接收信号再次由RAKE合成电路2进行RAKE合成,计算似然,根据似然来进行排序,生成与似然最高的码元对应的复本信号,从消除了最初的复本信号所得的信号中消除复本信号。对所有用户的所有码元重复这样的处理。

这样,在码元排序型中,由于不对每个用户生成复本信号,而对每个码元进行似然的排序,所以即使不形成多级结构也可以高精度生成复本信号。因此,在码元排序型中,具有解扩运算对所有码元进行依次即可的特征。作为窗口宽度,一般考虑时隙。

但是,在该码元排序型中,由于是以每1个码元来重复进行复本信号的消除和再排序处理的处理,所以产生变大的处理延迟。因此,在排序型的干扰消除器中,期望使排序处理简易。

发明内容

本发明的目的在于提供一种包括干扰消除器的无线基站装置及其无线通信方法,排序处理简单,处理延迟少,并且可以用少的解扩运算量来高精度生成复本信号。

本发明的主题以改善DS-CDMA系统的无线基站装置中的接收特性为目的,在单级型多用户干扰消除器中,通过将多个子系统(sub-set)的每个子系统并行来进行排序处理或等级判定处理,可以简化排序电路。

附图说明

图1表示符号排序型的干扰消除器的结构方框图;

图2表示本发明的无线基站装置的示意结构的方框图;

图3表示本发明实施例1的无线基站装置的干扰消除器的内部结构的方框图;

图4表示上述实施例1的无线基站装置的干扰消除器的部分方框图;

图5表示本发明实施例2的无线基站装置的干扰消除器的内部结构的方框图;

图6表示上述实施例2的无线基站装置的干扰消除器的部分方框图;以及

图7是说明干扰消除器内部结构的图。

具体实施方式

以下,参照附图来详细说明本发明的实施例。

(实施例1)

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