[发明专利]具有用来确认串行传输数据正常性电路的数据处理装置无效

专利信息
申请号: 02122118.9 申请日: 2002-05-30
公开(公告)号: CN1389795A 公开(公告)日: 2003-01-08
发明(设计)人: 白石秀俊 申请(专利权)人: 日本电气株式会社
主分类号: G06F13/00 分类号: G06F13/00
代理公司: 中科专利商标代理有限责任公司 代理人: 陈瑞丰
地址: 日本*** 国省代码: 暂无信息
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摘要:
搜索关键词: 具有 用来 确认 串行 传输 数据 正常性 电路 数据处理 装置
【说明书】:

技术领域

本发明涉及一种将串行数据传输到外部数据处理终端的数据处理装置,或者既能将串行数据传输到外部数据处理终端又能从外部数据处理终端接收串行数据的数据处理装置。

背景技术

目前可以获得的一种处理装置,能够完成与外部数据处理终端的数据通信。根据数据通信的形式,数据处理装置通过一个串行接口既能执行串行数据传输又能执行串行数据接收。

但是,当噪声从外部信源输入到串行接口时,从数据处理装置传输到数据处理终端的串行数据可能会出现数据错误。因此,有必要确认以串行数据传输方式传输的串行数据的反常性。

例如,日本专利公开特开平02-274031中公开了一种数据处理系统,这个系统包括数据处理装置和数据处理终端,其中每一个分别带有串行接口,用以进行数据传输和数据接收。数据处理终端将接收到的数据返回到数据处理装置,所述数据处理装置将被传输的数据与接收到的数据进行比较,以确认数据传输的正常性。

采用这种通过一个串行接口既能进行串行数据传输又能进行串行数据接收的数据处理装置,如果数据处理终端连续地保持以串行方式从串行接口接收到的串行数据,并在串行接收完毕后,将接收到的数据返回给数据处理装置,则该数据处理装置可将传输的数据和返回的数据进行相互比较。然而,由于这种数据处理装置通过单独一个串行接口以串行的方式接收串行数据,所述串行数据是通过串行方式传输的数据,所以这种数据处理装置不能实时地确认数据传输的正常性,并且其通信速率降低一半。

当这种数据处理装置对被传输的数据和从数据处理终端接收到的返回数据进行相互比较时,即使该数据处理装置终端确定传输数据和返回的数据彼此不一致,也不能确认数据错误是发生在数据向数据处理终端传输期间,抑或是发生在数据从数据处理终端返回期间。

发明内容

本发明的目的是提出一种数据处理装置,所述装置能够实时确认从一个串行接口以串行方式传输到数据处理终端的串行数据的正常性。

根据本发明的第一方面,一种数据处理装置包括:一个串行接口、数据传输单元、输出缓冲单元,以及数据比较电路,并能将串行数据传输到外部数据处理终端。

所述数据传输单元连续地产生要以串行方式传输的数据。连续产生的数据为输出缓冲单元所缓冲,然后以串行方式从串行接口传输到数据处理终端。当所述数据处理装置如此以串行方式将串行数据传输到数据处理终端时,数据比较单元确认从数据处理单元传输到输出缓冲单元的串行数据和从输出缓冲单元传输到串行接口的串行数据是否彼此一致。例如,如果由于串行接口中引入噪声的原因而在以串行方式从数据处理装置传输到数据处理终端的串行数据中发生错误,则该数据比较单元就能检测出从输出缓冲单元传输到串行接口的数据与从数据传输电路传输到输出缓冲电路的串行数据是不同的。

根据本发明的第二方面,一种数据处理装置包括:一个串行接口、数据接收单元、数据传输单元、输出缓冲单元、缓冲旁路通路、连接转换单元,以及数据比较单元,并能实现与外部数据处理终端之间的串行数据双向串行通信。

为进行串行接收,连接转换单元使所述缓冲旁路通路与数据接收单元相互连接,并且数据接收单元连续获得以串行方式从缓冲旁路通路通过串行接口接收到的数据。所述数据处理装置能以串行方式从数据处理终端接收串行数据。为进行串行传输,连接转换单元将数据传输单元连接在输出缓冲单元上,并且数据传输单元连续地产生要以串行方式传输的串行数据。这种连续产生的串行数据为输出缓冲单元所缓冲,然后再以串行方式从串行接口传输到数据处理终端。数据处理终端因此以串行方式从数据处理装置接收串行数据。

当数据处理装置以串行方式将串行数据传输到数据处理终端时,所述数据比较单元确认从数据传输单元传输到输出缓冲单元的串行数据是否与从输出缓冲单元从输出缓冲单元传输到串行接口的串行数据彼此一致。例如,如果因在数据处理装置与数据接收终端之间传输的串行数据不一致而在以串行方式从数据处理装置传输到数据处理终端的串行数据中产生错误,则所述数据比较单元就能检测到从输出缓冲单元传输到串行接口的串行数据不同于从数据传输单元传输到输出缓冲单元的串行数据。

从以下参照附图的描述将使本发明上述的和其它的目的,特性以及优点更加清楚,各附图说明本发明的几个示例。

附图说明

图1为本发明第一实施例数据处理装置的中心部分的方框图;

图2为本发明第二实施例数据处理装置的中心部分的方框图;

图3是表示在T=0规约的传输定时未发生奇偶校验差错的时序图;

图4是表示在传输定时发生奇偶校验差错的时序图;

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