[发明专利]纠错装置和纠错方法无效

专利信息
申请号: 02125176.2 申请日: 2002-05-17
公开(公告)号: CN1387323A 公开(公告)日: 2002-12-25
发明(设计)人: 古谷专一 申请(专利权)人: 松下电器产业株式会社
主分类号: H03M13/27 分类号: H03M13/27
代理公司: 中国国际贸易促进委员会专利商标事务所 代理人: 吴丽丽
地址: 日本*** 国省代码: 暂无信息
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摘要:
搜索关键词: 纠错 装置 方法
【说明书】:

技术领域

发明涉及卫星广播、地面波广播、电缆广播等数字传送中所需的纠错装置及纠错方法,尤其涉及对应于插在接收数据中的去交织模式对上述接收数据进行纠错的纠错装置和纠错方法。

技术背景

卷积去交织情况下为信道数和深度去交织的要素、块去交织情况下为行数和列数这种去交织的要素规则地插入到数据内的通信模式中,至今,考虑接收开始时和模式变更时使用保护模式的方法以及通过多个判定方法判定去交织模式的方法。

图7示出了现有纠错装置的构成。

输入端子102输入帧同步信号(fsync),输入端子103输入READ SOLOMON分组标题信号(psync1),输入端子104输入数据(data1)。

去交织装置108对输入数据(data1)进行由多个去交织模式判定装置109决定的去交织模式(dimode)的去交织。多个去交织模式判定装置109判定并决定多个去交织模式(dimode)。READ SOLOMON解码装置110对去交织后的数据(data2)进行READ SOLOMON解码。

输出端子111输出与数据(data3)同步的READ SOLOMON分组标题信号(psync3)。输出端子112输出与数据(data3)同步的READ SOLOMON分组错误信号(perror)。输出端子113输出READ SOLOMON解码后的数据(data3)。

下面对如上构成的纠错装置的动作进行说明。

数据(data1)、与该数据同步的帧同步信号(fsync)、及与该数据同步的READ SOLOMON分组标题信号(psync1)通过各输入端子102~104输入到上述多个去交织模式判定装置109及去交织装置108中。

在多个去交织模式判定装置109中,提取预定数目个规则地、例如按每帧插入通过输入端子104输入的数据(data1)中的去交织模式并进行多个判定,决定去交织模式(dimode),输出到上述去交织装置108。

接着,在去交织装置108中,对通过输入端子104输入的数据(data1)进行上述去交织模式(dimode)的去交织,将去交织后的数据(data2)及与该数据同步的READ SOLOMON分组标题信号(psync2)输出到READ SOLOMON解码装置110。

然后,在READ SOLOMON解码装置110中,对上述数据(data2)进行READSOLOMON解码并将数据(data3)输出到输出端子113,同时,将与该数据(data3)同步的READ SOLOMON分组标题信号(psync3)输出到输出端子111,将与该数据(data3)同步的READ SOLOMON分组错误信号(perror)输出到输出端子112。

在这种现有纠错装置中,通过多个去交织模式判定装置109,提取(例如每帧)预先决定的数目个规则地插入到输入数据(data1)中的去交织模式并进行多个判定,通过判定去交织模式,实现去交织。

在上述现有纠错装置中,在去交织装置的前段的解调部中,检测载波的时钟再现和帧同步/段同步的引入时间是必要的。由于载波频率高,时钟再现占据的时间比较短。对于帧同步/段同步,一般由多个判定检测,需要与用于检测去交织模式的引入时间几乎相同的引入时间。这样,用于去交织判定的引入时间在整个解调系统的引入时间中所占的比例大,因此,对整个解调系统的引入时间影响大。

但是,为了发送大量数据需要提高传送效率,其结果,需要去交织模式在所有数据中所占的比例低、整个解调系统高的引入时间。

发明内容

本发明旨在消除上述问题,目的是提供一种能减少去交织模式判定的引入时间的纠错装置及纠错方法。

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