[其他]模型法码速调整方法及调整装置在审

专利信息
申请号: 101985000000049 申请日: 1985-04-01
公开(公告)号: CN85100049B 公开(公告)日: 1987-11-25
发明(设计)人: 曾烈光;冯重熙 申请(专利权)人: 清华大学
主分类号: 分类号:
代理公司: 清华大学专利事务所 代理人: 胡兰芝
地址: 北京市海*** 国省代码: 北京;11
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摘要:
搜索关键词: 模型 法码速 调整 方法 装置
【权利要求书】:

1、一种正/零/负码速调整方法,其特征在于:

在码速调整时,先在正/零/负帧结构上进行一次模型参数为M0的固定速率的第一调整,此调整可为负(或正)调整,提供时隙K+N′(或K-P′)经相关处理,将第一调整每次调整引起的相位突变平均分配到调整周期的每个码元上,使之成为一均匀脉冲序列E,然后再根据低次群实际速率与第一调整提供的时隙速率之差进行一次正(或负)的第二调整,实现同步,第一调整的调整速率为M0,第二调整的调整速率为M0+fg;

在码速恢复时,先将第一调整提供时隙K+N′(或K-P′)经相关平滑后得到的均匀序列E和载信时隙恢复的第二调整序列P′(或N′)进行前置平滑,输出为E-P′(或E+N′),再将E-P′(或E+N′)经锁相环去除抖动,即再次平滑。

2、一种正/零/负码速调整装置,其特征在于:

在调整端,第一调整器①与第二调整器②之间接有相关器③和缓冲器④,两个调整器的输出经调整转移电路⑤送至缓冲存储器⑥的一个读出控制端,两个调整器的调整位置分别送至塞入指令形成电路⑦,高次群定时系统A提供时隙作为第一调整器①的输入,低次群定时B分别接至缓冲器④、第二调整器②和缓冲存储器⑥,低次群信码C接至缓冲存储器⑥,塞入指令形成电路⑦与缓冲存储器⑥的输出经相加器⑧后输出发码G;

在恢复端,收码D分别送至相关检测电路⑩、指令检测电路⑨、缓冲存储器,指令检测电路⑨的一个输出端与相关检测电路⑩相联,其另一个输出同相关检测电路⑩的输出均作为载信时隙恢复电路的输入信号,前置平滑器的输入为均匀序列E和载信时隙恢复电路的输出,其输出信号经锁相环送至缓冲存储器,缓冲存储器的另一个输入端直接与载信时隙恢复电路相连,并从缓冲存储器输出低次群信息F。

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