[发明专利]用于与存储器装置通信的系统和方法有效
申请号: | 200580017573.4 | 申请日: | 2005-10-24 |
公开(公告)号: | CN101133404A | 公开(公告)日: | 2008-02-27 |
发明(设计)人: | M·亨森;D·C·巴克 | 申请(专利权)人: | 西格马特尔公司 |
主分类号: | G06F13/28 | 分类号: | G06F13/28 |
代理公司: | 中国专利代理(香港)有限公司 | 代理人: | 张雪梅;刘杰 |
地址: | 美国德*** | 国省代码: | 美国;US |
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摘要: | |||
搜索关键词: | 用于 存储器 装置 通信 系统 方法 | ||
1.一种装置,包括:
存储器接口,其包括:
数据接口;
第一状态机,该第一状态机包括第一芯片选择接口和第一就绪/忙碌接口,该第一状态机被配置用于在第一存储器装置耦接到数据接口时分别经由该第一芯片选择接口和该第一就绪/忙碌接口选择并监视该第一存储器装置;以及
第二状态机,该第二状态机包括第二芯片选择接口和第二就绪/忙碌接口,该第二状态机被配置用于在第二存储器装置耦接到数据接口时分别经由该第二芯片选择接口和该第二就绪/忙碌接口选择并监视该第二存储器装置。
2.如权利要求1所述的装置,还包括控制接口,该控制接口被配置用于控制所述第一和第二存储器装置。
3.如权利要求1所述的装置,还包括直接存储器存取(DMA)控制器,所述第一状态机包括至该DMA控制器的第一通道,以及所述第二状态机包括至该DMA控制器的第二通道。
4.如权利要求3所述的装置,其中DMA控制器被配置用于通过存储器接口执行多页操作。
5.如权利要求1所述的装置,其中该存储器接口是先进的高速外围总线可访问的。
6.如权利要求1所述的装置,其中第一存储器装置是耦接到第一芯片选择接口和第一就绪/忙碌接口的第一快闪存储器装置,以及其中第二存储器装置是耦接到第二芯片选择接口和第二就绪/忙碌接口的第二快闪存储器装置。
7.如权利要求1所述的装置,其中存储器接口还包括第三状态机,该第三状态机包括第三芯片选择接口和第三就绪/忙碌接口。
8.如权利要求1所述的装置,还包括耦接到第一和第二状态机的仲裁电路。
9.如权利要求8所述的装置,还包括耦接到数据接口和仲裁电路的管脚状态机。
10.一种访问存储器的方法,该方法包括:
当第二快闪存储器装置处于忙碌状态时发送第一命令到第一快闪存储器装置,第一快闪存储器装置和第二快闪存储器装置耦接到数据接口,响应于第一命令,第一快闪存储器装置进入忙碌状态;
监视第二快闪存储器装置的就绪/忙碌信号;并且
当第一快闪存储器装置处于忙碌状态并且第二快闪存储器装置处于就绪状态时,发送第二命令到第二快闪存储器装置。
11.如权利要求10所述的方法,还包括监视第一快闪存储器装置的就绪/忙碌信号。
12.如权利要求11所述的方法,还包括响应于就绪/忙碌信号从第一状态机经由第一通道用信号通知直接存储器存取(DMA)控制器。
13.如权利要求11所述的方法,还包括:
响应于第二快闪存储器装置的就绪/忙碌信号经由第二通道用信号通知DMA控制器。
14.如权利要求10所述的方法,还包括当第一快闪存储器装置处于忙碌状态时,经由数据接口相对于第二快闪存储器装置传送数据。
15.如权利要求10所述的方法,还包括当第一快闪存储器装置和第二快闪存储器装置处于相应的忙碌状态时,发送第三命令到第三快闪存储器装置,该第三快闪存储器装置耦接到数据接口。
16.一种装置,包括:
处理核;
处理核可访问的第一内部数据总线;
第二内部数据总线;
第一数据总线和第二数据总线可访问的桥,该桥包括直接存储器存取(DMA)控制器;以及
第二数据总线可访问的存储器接口,该存储器接口包括:
数据接口;
控制接口;
第一状态机,该第一状态机包括第一芯片选择接口和第一就绪/忙碌接口,该第一状态机被配置用于在第一存储器装置耦接到数据接口和控制接口时分别经由该第一芯片选择接口和第一就绪/忙碌接口选择并监视第一存储器装置;以及
第二状态机,该第二状态机包括第二芯片选择接口和第二就绪/忙碌接口,该第二状态机被配置用于在第二存储器装置耦接到数据接口和控制接口时分别经由该第二芯片选择接口和第二就绪/忙碌接口选择并监视第二存储器装置。
17.如权利要求16所述的装置,其中该第一状态机包括至DMA控制器的第一通道,以及第二状态机包括至DMA控制器的第二通道。
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