[发明专利]利用标准单元通过自动布线形成的半导体集成电路器件以及固定其阱电位的设计方法有效
申请号: | 200580049245.2 | 申请日: | 2005-09-15 |
公开(公告)号: | CN101147147A | 公开(公告)日: | 2008-03-19 |
发明(设计)人: | 井高康仁;木下浩一;菅原毅 | 申请(专利权)人: | 株式会社东芝 |
主分类号: | G06F17/50 | 分类号: | G06F17/50;H01L27/02;H01L27/118;H01L21/66 |
代理公司: | 中国国际贸易促进委员会专利商标事务所 | 代理人: | 王以平 |
地址: | 日本*** | 国省代码: | 日本;JP |
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摘要: | |||
搜索关键词: | 利用 标准 单元 通过 自动 布线 形成 半导体 集成电路 器件 以及 固定 电位 设计 方法 | ||
1.一种半导体集成电路器件,包括:
通过配置单元列形成的电路部分,每个单元列具有沿第一方向和沿与第一方向交叉的第二方向配置的标准单元,
单元列包括:
第一标准单元,该第一标准单元的每个具有分别被施加电源电压和接地电位的第一和第二端子、和具有在施加于第一和第二端子之间的电压下工作的晶体管且没有阱电位固定有源区的第一电路;和
第二标准单元,该第二标准单元被配置在将以与第一标准单元相同的定时而被开关的晶体管集中的区域或者位于大晶体管附近,该第二标准单元的每个包括第三和第四端子以及第二电路,其中所述第三和第四端子被施加电源电压和接地电位,所述第二电路包括用于将形成于内部的空余区域中并分别电连接至第三和第四端子的阱的电位固定的第一和第二有源区、以及从第三和第四端子供给电源并从第一和第二有源区施加背栅偏置的晶体管,
其中,单元列中的第一标准单元的阱电位由第二标准单元固定。
2.权利要求1中记载的半导体集成电路器件,其中,
第二电路响应时钟信号而工作。
3.权利要求2中记载的半导体集成电路器件,其中,
第二电路为触发器或者缓冲器,并且
第一和第二有源区形成于与触发器或者缓冲器中的小晶体管相邻的第二标准单元中的空余区域中。
4.权利要求1中记载的半导体集成电路器件,其中,
每个第一标准单元包括:作为第一端子和第二端子的第一和第二电源线,所述第一和第二电源线设置在相向的两边并沿第一方向延伸;形成于半导体衬底中的第一导电类型的第一阱区;以及在半导体衬底中与第一阱区相邻地形成的第二导电类型的第二阱区,
每个第二标准单元包括:作为第三和第四端子的第三和第四电源线,所述第三和第四电源线设置在彼此相向的两边并沿第一方向延伸;形成于半导体衬底内的第一导电类型的第三阱区;以及在半导体衬底内与第三阱区相邻地形成的第二导电类型的第四阱区,
第一有源区形成在第三阱区中并与第五端子相接触,所述第五端子是通过将第三电源线在第二方向上分支出而形成的,以及
第二有源区形成在第四阱区中并与第六端子相接触,所述第六端子是通过将第四电源线在第二方向上分支出而形成的。
5.权利要求4中记载的半导体集成电路器件,其中,
单元列中的第一和第三电源线连接在一起,单元列中的第二和第四电源线连接在一起,单元列中的第一和第三阱区连接在一起,单元列中的第二和第四阱区连接在一起,
单元列中的第一和第二标准单元共用第一和第二电源线,
相邻的单元列共用连接在一起的第一和第三电源线或者共用连接在一起的第二和第四电源线。
6.一种半导体集成电路器件,包括:
通过配置单元列形成的电路部分,每个单元列具有沿第一方向和沿与第一方向交叉的第二方向配置的标准单元,
单元列包括:
第一标准单元,该第一标准单元的每个具有分别被施加电源电压和接地电位的第一和第二端子、和具有在施加于第一和第二端子之间的电压下工作的开关元件且没有阱电位固定有源区的第一电路;和
第二标准单元,被配置于第一标准单元中迁移概率高的区域附近,该第二标准单元的每个包括第三和第四端子以及第二电路,其中所述第三和第四端子被施加电源电压和接地电位,所述第二电路包括用于将形成于内部的空余区域中并分别电连接至第三和第四端子的阱的电位固定的第一和第二有源区、以及从第三和第四端子供给电源并从第一和第二有源区施加背栅偏置的晶体管,
其中,单元列中的第一标准单元的阱电位由第二标准单元固定。
7.权利要求6中记载的半导体集成电路器件,其中,
第二电路响应时钟信号而工作。
8.权利要求7中记载的半导体集成电路器件,其中,
第二电路为触发器或者缓冲器,并且
第一和第二有源区形成于与触发器或者缓冲器中的小晶体管相邻的第二标准单元中的空余区域中。
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