[发明专利]一种基于8位处理器的双总线电路无效
申请号: | 200610098006.2 | 申请日: | 2006-11-24 |
公开(公告)号: | CN101192208A | 公开(公告)日: | 2008-06-04 |
发明(设计)人: | 薛骏 | 申请(专利权)人: | 无锡盈泰科技有限公司 |
主分类号: | G06F13/40 | 分类号: | G06F13/40 |
代理公司: | 暂无信息 | 代理人: | 暂无信息 |
地址: | 214028江苏省*** | 国省代码: | 江苏;32 |
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摘要: | |||
搜索关键词: | 一种 基于 处理器 总线 电路 | ||
1.一种基于8位处理器的双总线电路,可以实现多个高速设备之间的高速数据传输,其特征是:电路系统中存在两条系统总线,一条低速系统总线和一条高速系统总线,低速设备与低速系统总线相连,高速设备与高速系统总线相连,系统存储单元通过总线选择电路与低速系统总线和高速系统总线都相连。
2.根据权利要求1所述的基于8位处理器的双总线电路,其特征是:高速系统总线是一个带有总线仲裁器和DMA控制器的共享式总线,它可以实现多个主控制器对多个从设备的访问功能。
3.根据权利要求1所述的基于8位处理器的双总线电路,其特征是高速系统总线的数据传输不影响低速系统总线的数据传输,高速系统总线数据传输的同时,8位处理器仍旧可以通过低速系统总线访问低速设备。
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