[实用新型]一种迟滞比较器无效
| 申请号： | 200620157551.X | 申请日： | 2006-11-24 |
| 公开（公告）号： | CN201011715Y | 公开（公告）日： | 2008-01-23 |
| 发明（设计）人： | 邹雪城;刘政林;郑朝霞;尹璐;田欢;骞海荣;王潇;涂熙 | 申请（专利权）人： | 华中科技大学 |
| 主分类号： | H03K5/24 | 分类号： | H03K5/24 |
| 代理公司： | 华中科技大学专利中心 | 代理人： | 曹葆青 |
| 地址： | 430074湖北*** | 国省代码： | 湖北;42 |
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| 摘要： | |||
| 搜索关键词： | 一种 迟滞 比较 | ||
【权利要求书】：
1.一种迟滞比较器，其特征在于：它包括NMOS管N1和N2、PMOS管P1、P2、P5和迟滞调节器(11)，其中，迟滞调节器(11)由PMOS管P6构成，用于调节比较器的阈值；NMOS管N1、N2对称，PMOS管P1、P2、P5的宽长比相等，PMOS管P6的宽长比大于PMOS管P1的宽长比；
NMOS管N1管栅极作为正输入端Vin1，NMOS管N2管的栅极作为负输入端Vin2，它们的源极相连，同时接尾电流源I1的正端，电流源I1的负端接地；NMOS管N1漏极与PMOS管P1漏极相连，并连接到迟滞调节器(11)中PMOS管P6漏极；PMOS管P1的漏级与栅级相连，成二极管连接；NMOS管N2的漏极与PMOS管P2漏极相连，同时连接到PMOS管P5的漏极；PMOS管P2漏极与其栅极相连，PMOS管P1与P5的栅极相连，PMOS管P6与PMOS管P2的栅极相连；PMOS管P1、P2、P5、P6的源极相连，一起接入电源VDD；PMOS管P6的负输出端VO1从NMOS管N1的漏极引出，PMOS管的正输出端VO2从NMOS管N2管的漏极引出。
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