[发明专利]互连结构及其制造方法有效
申请号: | 200680012049.2 | 申请日: | 2006-04-07 |
公开(公告)号: | CN101390203A | 公开(公告)日: | 2009-03-18 |
发明(设计)人: | 杨智超;L·A·克莱文格;A·P·考利;T·J·达尔顿;M·H·允 | 申请(专利权)人: | 国际商业机器公司 |
主分类号: | H01L21/4763 | 分类号: | H01L21/4763 |
代理公司: | 北京市中咨律师事务所 | 代理人: | 于 静;李 峥 |
地址: | 美国*** | 国省代码: | 美国;US |
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摘要: | |||
搜索关键词: | 互连 结构 及其 制造 方法 | ||
1.一种制造互连结构的方法,包括以下步骤:
提供具有介质层的衬底;
在所述介质层的顶表面上形成硬掩模层;
在所述硬掩模层中形成开口;
在所述介质层未被所述硬掩模层保护处的所述介质层中形成沟槽,所 述沟槽具有侧壁和底;
凹入在所述硬掩模层之下的所述沟槽的所述侧壁;
在所述沟槽和所述硬掩模层的所有暴露的表面上形成保形导电衬里;
使用芯导体填充所述沟槽;
去除在所述介质层的所述顶表面之上延伸的所述导电衬里的部分并 去除所述掩模层;以及
在所述芯导体的顶表面上形成导电帽。
2.根据权利要求1的方法,还包括:
在所述导电衬里与所述沟槽的所述侧壁接触处的所述导电衬里上形成 介质衬里。
3.根据权利要求2的方法,其中所述形成所述介质衬里包括以下步 骤:
在使用所述芯导体填充所述沟槽之前,在所述导电衬里的暴露的表面 上形成介质衬里;以及
从所述导电衬里与所述沟槽的所述底表面接触处的所述导电衬里的表 面去除所述介质衬里。
4.根据权利要求1的方法,其中所述形成保形导电衬里包括:
在所述沟槽的所述侧壁上同时淀积和溅射蚀刻金属层。
5.根据权利要求4的方法,其中所述形成保形导电衬里还包括在所述 同时淀积和溅射蚀刻之后在所述沟槽的所述侧壁上的所述金属层上淀积 另一金属层。
6.根据权利要求4的方法,其中所述溅射蚀刻产生来自选自Ar、He、 Ne、Xe、N2、H2NH3、N2H2及其组合的气体的溅射种。
7.根据权利要求4的方法,其中所述金属层包括选自Ta、TaN、Ti、 TiN、TiSiN、W、Ru及其组合的材料。
8.根据权利要求1的方法,其中所述导电衬里和所述导电帽是构成所 述芯导体的一种或多种材料的扩散阻挡层。
9.根据权利要求1的方法,其中所述硬掩模层包括选自SiO2、Si3N4、 SiC、SiON、SiOC、SiCOH、等离子体增强硅氮化物或SiC(N,H)的材 料。
10.根据权利要求1的方法,其中所述介质层包括具有4或更小的相 对介电常数的介质材料。
11.根据权利要求10的方法,其中所述介质层包括选自氢倍半硅氧烷 聚合物、甲基倍半硅氧烷聚合物、聚亚苯基低聚物、SiO2及其组合的材料。
12.根据权利要求1的方法,其中所述导电衬里包括选自Ta、TaN、 Ti、TiN、TiSiN、W、Ru及其组合的材料。
13.根据权利要求1的方法,其中所述芯导体包括选自Al、AlCu、 Cu、W、Ag、Au及其组合的材料。
14.根据权利要求1的方法,其中所述导电帽包括选自CoWP、 CoSnP、CoP、Pd或其组合的材料。
15.根据权利要求1的方法,其中所述介质层包括在第二介质层的顶 表面上形成的第一介质层,所述第一介质层是构成所述芯导体的一种或多 种材料的扩散阻挡层。
16.根据权利要求1的方法,其中所述形成导电帽包括所述导电帽的 至少一部分的无电镀敷。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造