[发明专利]在多个视频处理单元(VPU)的系统中的帧同步无效
申请号: | 200680017520.7 | 申请日: | 2006-05-26 |
公开(公告)号: | CN101198988A | 公开(公告)日: | 2008-06-11 |
发明(设计)人: | T·凯利;R·卡杜里;D·贝尔 | 申请(专利权)人: | ATI技术公司 |
主分类号: | G06T15/00 | 分类号: | G06T15/00 |
代理公司: | 永新专利商标代理有限公司 | 代理人: | 林锦辉 |
地址: | 加拿大*** | 国省代码: | 加拿大;CA |
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摘要: | |||
搜索关键词: | 视频 处理 单元 vpu 系统 中的 同步 | ||
1.一种系统,包括:
系统存储器,由所述系统中的组件经由总线共享;
多个处理器,用于对共同任务进行共享处理,每个所述处理器包括从包含以下各项的组中所选择的至少一种通信机制:本地存储器、信号量机制、以及用于经由所述总线访问所述系统存储器的虚拟存储器机制;以及
驱动器,被耦合到所述多个处理器中的每一个,用于向每个所述处理器并发地发出相同的命令缓冲器以便完成所述共同任务,其中,所述共同任务的完成包括至少一个同步点,所述命令缓冲器包括用于在所述同步点处协调数据传送的至少一种同步机制,所述至少一种机制从包含以下各项的组中选出:所述信号量机制、所述虚拟存储器机制、以及经由所述系统总线访问所述系统存储器。
2.一种系统,包括:
至少一个驱动器,可配置为构建与执行处理任务相关的一组命令和数据;以及
多个处理器,被耦合来接收该组命令和数据,并且可配置为共享所述处理任务,其中,所述多个处理器还可配置为,使用根据该组命令和数据而确定的通信机制来彼此通信,以便使所述处理任务同步。
3.如权利要求2所述的系统,其中,所述多个处理器每一个都包括:
至少一个存储设备,可由所述多个处理器经由所述通信机制进行访问;
至少一个寄存器,可由所述多个处理器经由所述通信机制进行访问;以及
通信单元,包括信号量机,所述信号量机可配置为便于实现所述通信机制。
4.如权利要求3所述的系统,其中,该组命令和数据包括:
至少一个信号量命令,用于使所述多个处理器中的至少一个读取在该处理器的至少一个存储设备中和/或者在该处理器的至少一个寄存器中的一等待信号量;以及
至少一个信号量命令,用于使所述多个处理器中的至少一个把信号量写入到另一处理器的至少一个存储设备和/或者至少一个寄存器中,以便释放一等待信号量。
5.如权利要求2到4中任何一项所述的系统,其中:
所述多个处理器包括视频处理单元(VPU);并且
所述共享处理任务包括渲染视频帧。
6.如权利要求5所述的系统,其中,所述共享处理任务包括至少一个同步点,所述同步点包括:
VPU到VPU的数据传送;
交换锁定事件;以及
将所述视频帧渲染到共享存储器。
7.一种视频处理设备,被配置为:
接收一组共用的命令,该组共用命令可以被所述设备和其它视频处理器并发地进行解释;并且
解释在该组共用命令中的同步命令,以便访问在所述设备之外存储的信息,其中,所述信息与将要由所述设备采取的动作相关,所述动作用于使所述设备和其它视频处理器对该组命令的并发执行进行同步,其中,所述同步命令包括信号量命令和存储器访问命令。
8.一种视频处理卡,包括:
被配置为构建用于处理视频数据的一组命令的电路,包括在同步点处插入用于使执行该组命令的多个处理器同步的同步命令;以及
被配置为接收该共用组并且解释在该组共用命令中的同步命令以便访问在所述卡之外存储的信息的电路,其中,所述信息与将要由所述电路采取的动作相关,所述动作用于使所述电路及在所述卡之外的其它电路对该组命令的并发执行进行同步,其中,所述同步命令包括信号量命令和存储器访问命令。
9.一种多处理器方法,包括:
多个处理器中的每一个接收与任务相关的一组命令;并且
所述多个处理器共享对所述任务的执行,并且所述共享包括按照要求进行动作同步,以便在没有错误的情况下执行所述任务,其中,同步包括按照该组命令的指示,经由信号量机制来进行处理器间通信。
10.如权利要求9所述的方法,还包括:驱动器构建该组命令,包括插入信号量命令和同步点。
11.如权利要求10所述的方法,其中,所述任务包括渲染视频帧,并且所述同步点包括在该组命令中发生同步的点,所述同步点包括:
VPU到VPU的数据传送;
交换锁定事件;以及
将所述视频帧渲染到共享存储器。
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