[发明专利]用于异步过采样、同步分数间隔均衡化以及数字增益控制的读取通道设备无效

专利信息
申请号: 200680031148.5 申请日: 2006-07-03
公开(公告)号: CN101248493A 公开(公告)日: 2008-08-20
发明(设计)人: E·埃莱夫特里乌;S·厄尔策尔;G·A·伽奎特;J·耶利托;R·A·哈钦斯 申请(专利权)人: 国际商业机器公司
主分类号: G11B20/10 分类号: G11B20/10;H04N5/52
代理公司: 北京市中咨律师事务所 代理人: 于静;李峥
地址: 美国*** 国省代码: 美国;US
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摘要:
搜索关键词: 用于 异步 采样 同步 分数 间隔 均衡 以及 数字 增益 控制 读取 通道 设备
【权利要求书】:

1.一种读取通道,其包含:

异步模拟到数字转换器,其以大于第一速率的速率对通过读取数据轨道形成的模拟信号进行异步采样,其中,所述数据轨道以所述第一速率被写入数据存储介质;

内插器,其与所述模拟到数字转换器互连;

分数间隔均衡器,其与所述内插器互连,其中,所述内插器以内插速率向所述分数间隔均衡器提供内插采样,且其中,所述分数间隔均衡器以均衡化速率形成同步均衡化采样,其中,所述内插速率大于或等于所述均衡化速率,且其中,所述内插速率大于所述第一速率;

增益控制模块,其与所述分数间隔均衡器互连;以及

序列检测器,其与所述增益控制模块互连。

2.根据权利要求1的读取通道,其还包含在异步领域内以大于所述第一速率的速率对所述模拟信号进行过采样的上采样器。

3.根据权利要求2的读取通道,其还包含第一反馈电路,该电路包含与所述序列检测器以及所述内插器互连的定时控制电路。

4.根据权利要求3的读取通道,其还包含第二反馈电路,该电路包含与所述序列检测器以及所述分数间隔均衡器互连的最小均方更新电路。

5.根据权利要求4的读取通道,其还包含第三反馈电路,该电路与所述序列检测器以及所述增益控制模块互连。

6.根据权利要求5的读取通道,其中,所述第二反馈电路与所述第三反馈电路解耦合。

7.根据权利要求6的读取通道,其中,所述序列检测器包含部分响应最大似然序列检测器。

8.根据权利要求6的读取通道,其中,所述序列检测器包含噪音预测最大似然序列检测器。

9.根据权利要求8的读取通道,其中,所述噪音预测最大似然序列检测器包含分支度量计算算法和多个预测器滤波器,其中,所述预测器滤波器被嵌入所述分支度量计算算法,其中,所述算法的每个变化与所述多个预测器滤波器中不同的一个相关联。

10.一种读取在数据存储介质中编码的信息的方法,其包含以下步骤:

提供读取通道,所述读取通道包含模拟到数字转换器、与所述模拟到数字转换器互连的内插器、与所述内插器互连的分数间隔均衡器、与所述分数间隔均衡器互连的增益控制模块以及与所述增益控制模块互连的序列检测器;

读取被写入数据存储介质的数据轨道以形成模拟信号,其中,所述数据轨道包含以第一速率编码的信息;

以固定的采样速率对所述模拟信号进行异步采样,以形成采样信号;

形成内插采样;

以内插速率将所述内插采样提供给所述分数间隔均衡器,其中,所述内插速率大于所述第一速率;

以均衡化速率形成同步均衡化采样,其中,所述均衡化速率小于所述内插速率;

调节所述均衡化采样的增益;

使用所述增益调节后的同步均衡化采样检测表示最大似然序列估计的数据符号。

11.根据权利要求10的方法,其中,所述提供步骤还包含提供上采样器,所述方法还包含以上采样速率在异步领域中进行上采样的步骤,其中,所述上采样速率大于所述第一速率。

12.根据权利要求10的方法,其还包含以下步骤:

提供定时控制电路,该电路与所述序列检测器以及所述内插器互连;

产生定时信号;

将所述定时信号提供给所述内插器。

13.根据权利要求12的方法,其还包含以下步骤:

产生均衡器误差信号;

将所述均衡器误差信号提供给所述分数间隔均衡器。

14.根据权利要求13的方法,其还包含以下步骤:

产生通过来自所述序列检测器的决策形成的信号估计;

其中,在增益控制之前,所述产生均衡器误差信号的步骤还包含产生包含所述信号估计与延迟均衡化信号之间的差的均衡器误差信号。

15.根据权利要求14的方法,其还包含以下步骤:

产生包含延迟增益调节信号与所述信号估计之间的差的增益控制误差信号;

将所述增益控制误差信号提供给所述增益控制模块;

其中,所述产生均衡器误差信号的步骤与所述产生增益控制误差信号的步骤解耦合。

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