[发明专利]GPS时统终端系统无效
申请号: | 200710056154.2 | 申请日: | 2007-10-11 |
公开(公告)号: | CN101145777A | 公开(公告)日: | 2008-03-19 |
发明(设计)人: | 冯强;曹立华;耿爱辉 | 申请(专利权)人: | 中国科学院长春光学精密机械与物理研究所 |
主分类号: | H03L7/00 | 分类号: | H03L7/00;H03L7/24;G04G7/02;G01S1/02 |
代理公司: | 长春菁华专利商标代理事务所 | 代理人: | 赵炳仁 |
地址: | 130033吉*** | 国省代码: | 吉林;22 |
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摘要: | |||
搜索关键词: | gps 终端 系统 | ||
技术领域
本发明涉及一种GPS时统终端系统,特别涉及一种光电测量设备GPS时统终端系统。
背景技术
时间统一系统简称时统终端系统,是向大型光电测量设备提供标准时间信号和标准频率信号以实现整个系统的时间和频率的统一,由各种电子设备组成的一套完整的系统。GPS时统终端系统就是以GPS时间为基准时间的一种时统终端系统,它主要的功能分为两大部分,一部分是提供给整个系统所需的绝对时间即GPS时间信息和位置信息;另一部分就是为各分系统提供各自所需的同步采样频率信号。
GPS不仅是高精度全球定位系统,而且也是高精度的实时标准时间信号系统。分散数千千米之遥的各GPS接收模块输出的时间信号1pps(秒脉冲)与标准时间的最大误差不超过±1μs,所以可以认为是同步的。因此,若大型光电测量设备的各分系统都采用GPS时间校时,则各分系统可取得高精度的时间同步。
目前,大型光电测量设备所使用的GPS时统终端系统采用单片机作为数据处理单元,需要设计复杂的外围电路,并且单片机运算速度慢,因而整个系统结构复杂、可靠性差、体积大、速度慢。
发明内容
本发明要解决的技术问题是提供一种的结构简单、可靠性好、体积小、速度快的GPS时统终端系统。
本发明包括数字信号处理器,GPS接收模块,通讯模块,晶振,分频电路;GPS接收模块与数字信号处理器的串口连接,将GPS信息传递给数字信号处理器;数字信号处理器控制数据的收发,以及将GPS接收模块传输的GPS信息进行处理,并将处理结果通过通讯模块串行输送出去;晶振为分频电路提供标准基础时钟;GPS接收模块为分频电路提供GPS秒信号作为分频链的同步清零信号;分频电路将晶振产生的标准基础时钟进行分频,产生各分系统所需的同步采样频率信号。
本发明采用数字信号处理器作为数据处理单元,因而集成度高,结构简单,可靠性好,体积小,并且运算速度快,特别适用于为大型光电测量设备提供标准时间信号和标准频率信号以实现整个设备的时间和频率的统一。
所述通讯模块采用多通道异步串行通讯芯片;片选电路分别与数字信号处理器和异步串行通讯芯片连接,可以根据数字信号处理器提供的地址选通异步串行通讯芯片的串行通道,提高了数据传输效率。
所述分频电路和片选电路为可编程逻辑芯片内部逻辑电路,这进一步提高了本发明的集成度。
作为本发明的另一个改进是:数据存储器与数字信号处理器连接,作为数字信号处理器外扩的程序和数据存储器,以便数字信号处理器能够进行在线仿真。
下面结合附图和具体实施方式对本发明作进一步详细说明。
附图说明
图1为本发明结构示意图,也是摘要附图。图中1为数字信号处理器,2晶振,3为GPS接收模块,4可编程逻辑芯片,5通讯模块,6数据存储器,7接口电路,8分频电路,9片选电路。
图2为本发明具体实施方式结构示意图。1为数字信号处理器,2晶振,3为GPS接收模块,4可编程逻辑芯片,5通讯模块,6数据存储器,7接口电路。
图3为本发明数字信号处理器1内部主程序流程图。
图4为数字信号处理器1内部中断子程序流程图。
具体实施方式
如图1所示本发明硬件电路主要是由数字信号处理器1,GPS接收模块3,晶振2,分频电路8,片选电路9,数据存储器6,通讯模块5以及一些外围电平转换芯片构成。通讯模块5采用多通道异步串行通讯芯片;分频电路8和片选电路9采用可编程逻辑芯片4编程实现;GPS接收模块3与数字信号处理器1的串口连接,GPS信息传递给数字信号处理器1;数字信号处理器1控制数据的收发,以及将GPS接收模块3传输的GPS信息进行处理,片选电路9根据数字信号处理器1提供的地址选通异步串行通讯芯片的串行通道;数字信号处理器1的处理结果通过异步串行通讯芯片和接口电路7串行输送出去。晶振2为分频电路8提供标准基础时钟;GPS接收模块3为分频电路8提供GPS秒信号作为分频链的同步清零信号;分频电路8将晶振2产生的标准基础时钟进行分频,产生同步采样频率信号。同步采样频率信号经接口电路7输送给各分系统。
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