[发明专利]高分辨率音频体系结构无效
申请号: | 200710096996.0 | 申请日: | 2007-04-26 |
公开(公告)号: | CN101087144A | 公开(公告)日: | 2007-12-12 |
发明(设计)人: | 徐兆顺;艾德里安·乔纳森 | 申请(专利权)人: | 创新科技有限公司 |
主分类号: | H03M7/30 | 分类号: | H03M7/30;G10L19/00;H04B1/66 |
代理公司: | 北京东方亿思知识产权代理有限责任公司 | 代理人: | 李晓冬 |
地址: | 新加坡*** | 国省代码: | 新加坡;SG |
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摘要: | |||
搜索关键词: | 高分辨率 音频 体系结构 | ||
1.一种被布置为与主机接口和一个或多个非兼容高分辨率音频的编码器/解码器通信的装置,所述装置包括:
可连接到所述一个或多个非兼容高分辨率音频的编码器/解码器并且与高分辨率音频控制器兼容的逻辑电路,所述逻辑电路被布置为向所述高分辨率音频控制器发送响应,所述响应仿真兼容高分辨率音频的编码器/解码器的响应。
2.如权利要求1所述的装置,还包括与所述逻辑电路兼容并且可连接到所述主机接口的所述高分辨率音频控制器。
3.如权利要求2所述的装置,其中,所述装置采用集成电路的形式。
4.如权利要求2所述的装置,其中,所述主机接口是外围部件接口。
5.如权利要求2所述的装置,其中,所述一个或多个编码器/解码器中的至少一个是从由以下项组成的组中选出的类型的编码器/解码器:Sony/Phillips数字接口和Inter-IC-Sound。
6.如权利要求1所述的装置,其中,所述逻辑电路利用由以下项组成的组中选出的数据来与所述一个或多个非兼容高分辨率音频的编码器/解码器通信:复用的数据和未复用的数据。
7.如权利要求1所述的装置,其中,所述主机接口可位于所述装置的上游侧,并且所述一个或多个非兼容高分辨率音频的编码器/解码器可位于所述装置的下游侧。
8.如权利要求2所述的装置,其中,所述主机接口可位于所述高分辨率音频控制器的上游侧。
9.权利要求1所述的装置与用于存储所述一个或多个非兼容高分辨率音频的编码器/解码器的供应商专用指令的存储器存储装置的组合。
10.如权利要求9所述的组合,其中,所述供应商专用指令是从由下列项组成的组中选择的:I2C命令、SPI命令和MIDI命令。
11.如权利要求9所述的组合,其中,所述存储器存储装置还被布置为存储所述一个或多个非兼容高分辨率音频的编码器/解码器的配置。
12.如权利要求11所述的组合,其中,所述被仿真的响应是基于所述被存储的配置的。
13.权利要求1所述的装置和用于存储所述一个或多个非兼容高分辨率音频的编码器/解码器的配置的存储器存储装置的组合。
14.一种装置,可位于所述装置的上游侧的主机接口和所述装置的下游侧的一个或多个非兼容高分辨率音频的编码器/解码器之间,所述装置包括:
可连接到所述装置的上游侧的主机接口的高分辨率音频控制器;和
所述高分辨率音频控制器的下游侧的逻辑电路,该逻辑电路可连接到所述装置的下游侧的所述一个或多个非兼容高分辨率音频的编码器/解码器,并且与所述逻辑电路的上游侧的高分辨率音频控制器兼容,所述逻辑电路被布置为能够在启动和正常操作期间向所述高分辨率音频控制器发送响应,所述响应仿真兼容高分辨率音频的编码器/解码器的响应。
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