[发明专利]时钟切换电路无效
申请号: | 200710104253.3 | 申请日: | 2007-05-23 |
公开(公告)号: | CN101079625A | 公开(公告)日: | 2007-11-28 |
发明(设计)人: | 三池祥五 | 申请(专利权)人: | 恩益禧电子股份有限公司 |
主分类号: | H03L7/08 | 分类号: | H03L7/08;H03L7/095 |
代理公司: | 中原信达知识产权代理有限责任公司 | 代理人: | 关兆辉;孙志湧 |
地址: | 日本*** | 国省代码: | 日本;JP |
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摘要: | |||
搜索关键词: | 时钟 切换 电路 | ||
1.一种时钟切换电路,用于对具有不同相位的多个时钟进行切换和输出,其包括:
第一相位调节电路,用于在输入了第一外部时钟之后输出第一相位调节时钟;
选择单元,用于选择和输出第一相位调节时钟或者具有与第一相位调节时钟不同相位的另一时钟;以及
切换控制单元,当异步切换指令信号被输入其中时,用于根据第一相位调节时钟和异步切换指令信号使选择单元经受切换控制,其中该异步切换指令信号与该另一时钟相异步,其与偏移时钟相同步地对选择单元的输出进行切换,该偏移时钟与第一相位调节时钟的相位偏离了预定值。
2.根据权利要求1的时钟切换电路,进一步包括:第二相位调节电路,在输入了与第一外部时钟具有不同相位的第二外部时钟之后,其用于输出第二相位调节时钟,
其中选择单元选择并输出第一相位调节时钟或者第二相位调节时钟的反相信号。
3.根据权利要求2的时钟切换电路,其中第一和第二相位调节电路分别是用于输出第一PLL时钟的第一PLL电路和用于输出第二PLL时钟的第二PLL电路;
锁定状态检测电路,配置用于检测第一PLL电路的锁定状态,
在检测到第一PLL电路已经进入锁定状态之后,该锁定状态检测电路输出用作异步切换指令信号的检测信号,以及
切换控制单元,当检测信号被输入到其中时,其用于与偏移时钟相同步地将选择单元的输出从第二PLL时钟的反相信号切换到第一PLL时钟。
4.根据权利要求2的时钟切换电路,其中第一外部时钟的相位与第二外部时钟的相位相差180°。
5.根据权利要求3的时钟切换电路,其中第一外部时钟的相位与第二外部时钟的相位相差180°。
6.根据权利要求2的时钟切换电路,其中每个第一和第二PLL电路包括反馈路径,用于输出分别与第一和第二外部时钟具有预定相位差的第一和第二PLL时钟。
7.根据权利要求3的时钟切换电路,其中第一和第二PLL电路的每一个包括反馈路径,其用于输出分别与第一和第二外部时钟具有预定相位差的第一和第二PLL时钟。
8.一种时钟切换电路,其包括:
第一外部/内部时钟选择单元,用于选择并输出第一外部时钟或者第一内部时钟;
PLL电路,在输入了与第一外部时钟具有不同相位的第二外部时钟之后,用于输出PLL时钟;
第二外部/内部时钟选择单元,用于选择并输出第二外部时钟或者PLL时钟,其作为与第一内部时钟具有不同相位的第二内部时钟;以及
第一和第二切换控制单元,用于根据与第一和第二外部时钟异步地从外部提供的异步切换指令信号,分别使第一和第二外部/内部时钟选择单元经受切换控制,
其中当异步切换指令信号被输入到其中时,第一和第二切换控制单元与第一和第二偏移时钟相同步地对第一和第二外部/内部时钟选择单元的输出进行切换,其中所述第一和第二偏移时钟与第一和第二PLL时钟的相位分别偏离了预定值。
9.根据权利要求8的时钟切换电路,其中第一内部时钟是PLL时钟的反相信号。
10.根据权利要求8的时钟切换电路,进一步包括:
第一PLL电路,用于在输入第一外部时钟之后输出第一PLL时钟;以及
选择单元,用于选择并输出第一内部时钟,
其中PLL电路是用于输出第二PLL时钟的第二PLL电路,以及
选择单元选择并输出第一PLL时钟或者第二PLL时钟的反相信号作为第一内部时钟。
11.根据权利要求10的时钟切换电路,进一步包括:第一锁定状态检测电路,用于检测第一PLL电路的锁定状态,
其中在检测到第一PLL时钟已经进入锁定状态之后,该第一锁定状态检测电路输出与第一PLL时钟相异步的检测信号,以及
第一切换控制单元,当检测信号被输入其中时,其用于与第一偏移时钟相同步地将选择单元的输出从第二PLL时钟的反相信号切换到第一PLL时钟。
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