[发明专利]视频编码器与图形处理单元有效

专利信息
申请号: 200710110192.1 申请日: 2007-06-18
公开(公告)号: CN101068364A 公开(公告)日: 2007-11-07
发明(设计)人: 扎伊尔德·荷圣;库玛斯·萨伯丁 申请(专利权)人: 威盛电子股份有限公司
主分类号: H04N7/26 分类号: H04N7/26;H04N7/24
代理公司: 北京市柳沈律师事务所 代理人: 周少杰
地址: 中国台*** 国省代码: 中国台湾;71
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摘要:
搜索关键词: 视频 编码器 图形 处理 单元
【说明书】:

技术领域

发明关于影像压缩与解压缩,且尤其是关于具有影像压缩与解压缩特征的图形处理单元。 

背景技术

个人计算机与消费性电子产品用于各种娱乐用品。这些娱乐用品可以大致区分为2类:使用计算机制图(computer-generated graphics)的那些,例如计算机游戏;与使用压缩视频数据流(compressed video stream)的那些,例如预录节目到数字式影音光盘(DVD)上,或由有线电视或卫星业者提供数字节目(digital programming)至一机顶盒(set-top box)。第2种亦包含编码模拟视频数据流,例如由一数字录影机(DVR,digital video recorder)所执行。 

计算机制图通常由一图形处理单元(GPU,graphic processing unit)产生。图形处理单元是一种建立在计算机游戏平台(computer game consoles)与一些个人计算机上的一种特别微处理器。图形处理单元被最佳化为快速执行描绘三维空间基本物体(three-dimensional primitive objects),例如三角形、四边形等。这些基本物体以多个顶点描述,其中每个顶点具有属性(例如颜色),且可施加纹理(texture)至该基本物体上。描绘的结果是一二维空间像素阵列(two-dimensional array of pixels),显示在一计算机的显示器或监视器上。 

视频数据流的编码与解码牵涉到不同种类的运算,例如,离散余弦变换(discrete cosine transform)、运动估计(motion estimation)、运动补偿(motioncompensation)、去方块效应滤波器(deblocking filter)。这些计算通常由通用中央处理器(CPU)结合特别的硬件逻辑电路,例如特殊应用集成电路(ASICs,application specific integrated circuits),来处理。消费者因而需要多个运算平台以满足他们的娱乐需求。因而需要可以处理计算机制图与视频编码/解码的单一计算平台。 

发明内容

在此公开的实施例提供一种用于视频压缩去方块效应的系统与方法。一示范性图形处理单元(GPU)包含:一解码器,设置成解码一第一与一第二去方块效应滤波器加速指令,该第一与第二去方块效应滤波加速器指令均与被一特定视频解码器所使用的一去方块效应滤波器相关;以及一视频处理单元,设置成接收由该第一去方块效应滤波器加速指令所编码的第一参数,并判断由该接收第一参数所规范的第一存储器源,该第一存储器源位于该图形处理单元的多个存储器源其中之一,并接收由该第二去方块效应滤波器加速指令所编码的第二参数,并判断由该接收第二参数所规范的第二存储器源,该第二存储器源位于该图形处理单元的多个存储器源其中之一,其中该视频处理单元还设置成从所判断的第一存储器源下载一第一像素数据方块,并将该去方块效应滤波器应用于该第一像素数据方块,并从所判断的第二存储器源下载一第二像素数据方块,并将该去方块效应滤波器应用于该第二像素数据方块,其中该多个存储器源包含在该图形处理单元内的一纹理高速缓存器与一执行单元。 

附图说明

图1是用于图形与视频编码和/或解码的一示范性运算平台的方块图。 

图2是图1中该视频解码器160的方块图。 

图3说明一VC-1滤波器的子方块像素设置。 

图4是图1VC-1回路内去方块效应滤波器硬件加速逻辑电路400的硬件描述虚拟码的列表。 

图5是图4行加速逻辑电路500的硬件描述语言程序代码的列表。 

图6A-D形成图4、5的行加速逻辑电路的一方块图。 

图7H.264回路内去方块效应滤波器硬件加速单元700的硬件描述虚拟码。 

图8A与8B显示用于行加速逻辑电路800的硬件描述虚拟码。 

图9是图1的图形处理单元120的数据流程图。 

图10是H.264所用的16x16宏块的方块图。 

【主要元件符号说明】 

100~系统、110~通用CPU、120~图形处理器(GPU)、130~存储器、140~总线、150~视频加速单元(VPU)、160~软件解码器、170~视频加速 驱动器。 

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