[发明专利]一种实现以太网建链和收发包指示的方法及装置有效
申请号: | 200710122549.8 | 申请日: | 2007-09-26 |
公开(公告)号: | CN101132287A | 公开(公告)日: | 2008-02-27 |
发明(设计)人: | 闫强;焦赵云;陆建鑫;罗向前 | 申请(专利权)人: | 中兴通讯股份有限公司 |
主分类号: | H04L12/08 | 分类号: | H04L12/08;H04L12/28 |
代理公司: | 北京汇泽知识产权代理有限公司 | 代理人: | 张颖玲 |
地址: | 518057广东省深圳市南山*** | 国省代码: | 广东;44 |
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摘要: | |||
搜索关键词: | 一种 实现 以太网 收发 指示 方法 装置 | ||
技术领域
本发明涉及以太网通信指示技术,特别是涉及一种实现以太网建链和收发包指示的方法及装置。
背景技术
随着网络的发展与普及,以太网以其低成本、高可靠性、安装简便、维护容易和易扩展等优点成为非常流行的局域网技术,并且,随着以太网地不断改进,速率的不断提高,其应用范围也从局域网扩展到城域网。
以太网物理层(PHY)芯片是以太网设备中与外部信号接口的芯片,主要用于提供以太网的接入通道。目前,大多数以太网PHY芯片能指示是否建链,并能通过发光二极管(LED,Light Emitting Diode)指示灯的闪烁来指示收发包的信息,但指示的方式并不统一,有的采用不同的LED灯分别来指示建链和收发包,有的采用一个LED灯指示。另外,还有些以太网PHY芯片或部分专用通信芯片的以太网接口,由于接口设计的问题,并不能指示建链及收发包信息,或是不能指示得很完备。
总体来说,现有以太网PHY芯片在能否指示建链和收发包信息方面存在两类主要的问题:
第一,不能完全符合用户操作习惯。一般,用户的操作需求是使用一个LED灯,当以太网建链时,LED灯能够亮,当有收发包时,LED灯能够闪烁。但现在的实际应用中,有的采用一个LED灯指示,有的采用多个LED灯指示,并不统一。
第二,不能完善的作出指示。虽然芯片本身能提供用户是否建链和是否有收发包的特定指示信息,但这些信息不能通过简单的电路直接提供到用户界面上。原因在于:一方面,由于没有专用管脚,特定指示信息无法直接传递并指示,例如:BROADCOM公司10G的PHY芯片BCM8705,由于没有专门通过LED指示建链和收发包的管脚,当有包收发时,只能通过通用输入输出(GPIO)管脚发出100us通、100us断的脉冲,如果采用这样的信号驱动LED,通过肉眼很难分辨这样的闪烁信号。另一方面,需要读取专门的寄存器,比如:BCM8705中,是否建链只有通过软件读取芯片的内部寄存器才能获知。
虽然,也可以采用通过软件发出驱动LED命令的方式来实现信息指示,但这样做,就需要CPU实时监控GPIO管脚信号的变化,而这个变化的频率非常快,一般可能为100us,该变化频率基本与CPU的运行速度相当,这样的话,如果CPU要反应所有的脉冲变化,基本上就无法处理其他的任何事情,不仅耗费大量的CPU资源,而且对于CPU负担较重的单板,付出的代价比较大。
发明内容
有鉴于此,本发明的主要目的在于提供一种实现以太网建链和收发包指示的方法及装置,能解决一些以太网PHY芯片信息指示不完善,LED灯指示不符合用户操作习惯的问题。
为达到上述目的,本发明的技术方案是这样实现的:
本发明提出一种实现以太网建链和收发包指示的方法,包括:
CPU根据从物理层PHY芯片获取的信息确定是否建链,在确定建链时,CPU将获取的建链信息写入可编程逻辑器件CPLD,CPLD根据得到的建链信息驱动LED灯亮;
CPLD检测是否收到收发包脉冲,在收到收发包脉冲时,经过延时或固定频率的处理,驱动LED灯闪烁。
该方法进一步包括:CPLD驱动LED灯闪烁后,如果在设定时间段内未收到收发包脉冲,则驱动LED灯切换为常亮。
该方法进一步包括:预先设定用于检测收发包脉冲是否连续发送的时间段长度。其中,所述时间段长度取值范围为2秒到5秒。
上述方案中,所述LED灯闪烁为响应闪烁、或为固定频率闪烁。
上述方案中,所述驱动LED闪烁具体为:初始化计数器值为0;在收到第一个收发包脉冲时启动计数,并在计数器值为闪烁周期长度一半时,对LED灯指示状态取反;在计数器值为闪烁周期长度时,对LED灯指示状态取反,同时对计数器值清零。相应的,该方法进一步包括:预先设定对应闪烁周期长度的计数器值,所述计数器取值范围为0.2秒到0.5秒。
本发明还提出一种实现以太网建链和收发包指示的装置,包括CPU、PHY芯片以及一个LED灯;关键在于,该装置还包括CPLD,连接于CPU、PHY芯片、LED灯之间,用于从CPU获得建链信息,从PHY芯片获取收发包信息,并控制LED灯的指示状态;
相应的,CPU用于从PHY芯片的内部寄存器读取建链信息,并将获取的建链信息写入CPLD。
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