[发明专利]用于改进通信错误的通信方法和使用所述方法的电子设备无效
申请号: | 200710128364.8 | 申请日: | 2007-07-10 |
公开(公告)号: | CN101150386A | 公开(公告)日: | 2008-03-26 |
发明(设计)人: | 朴汉镇 | 申请(专利权)人: | 三星电子株式会社 |
主分类号: | H04L1/24 | 分类号: | H04L1/24;H04L1/16;H04J3/06 |
代理公司: | 北京市柳沈律师事务所 | 代理人: | 邵亚丽;邸万奎 |
地址: | 韩国*** | 国省代码: | 韩国;KR |
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摘要: | |||
搜索关键词: | 用于 改进 通信 错误 方法 使用 电子设备 | ||
技术领域
符合本发明的装置和方法涉及一种用于改进通信错误的通信方法以及使用所述方法的电子设备,更具体地讲,涉及一种用于改进由I2C(被称作IC间或I平方C)通信中的从设备产生的通信错误的通信方法及使用所述方法的电子设备。
背景技术
I2C通信是最初由飞利浦开发的用于集成电路(ICs)之间的数据通信的串行通信方法,在所述方法中,称为主设备(master)的发起事务处理(transaction)或通信的设备通过两条信号线控制很多从设备(slave)。
图1是用于说明在I2C通信中使用的基本协议的图。
参考图1,在I2C通信中使用的信号线是串行数据(serial data,SDA)线和串行时钟(serial clock,SCL)线。SDA线用于主设备/从设备对(pairs)之间的事务处理,并且所述SCL线用于传输在数据传输中所要求的时钟信号。
如果SDA的电平从高变到低而SCL被保持在高电平,则主设备通过发出开始条件(start condition)来开始将数据传送到从设备。在另一方面,如果SCL的电平从低变到高而SDA被保持在高电平,则主设备通过发出停止条件(stop condition)来停止将数据传送到从设备。
当主设备完成以最高位(Most Significant Bit,MSB)打头(first)的7位数据传输时,在第9个时钟其将SDA保持为高。如果从设备从主设备接收到8位数据,则其在第9个时钟将SDA的电平变到低,并把确认接收(此后称作ACK信号)发送到主设备。
当从设备执行用于从主设备传送的命令的过程(或任务)时,SCL有时候被强制下拉到低电平,这导致主设备和从设备之间的通信错误。在某些情况中,由于将在传送ACK信号期间的第9个时钟周期识别为开始条件,从设备或者整个机组(set)发生故障。
发明内容
本发明的示范性实施例克服了上面的缺点以及上面未描述的其他缺点。而且,本发明未被要求克服上面描述的缺点,并且本发明的示范性实施例可以不克服上面描述的任何问题。
本发明的一个方面是提供一种通信方法以及结合所述通信方法以防止故障的电子设备,所述通信方法用于通过使主设备提供调整到从设备的工作时间的时钟来改进通信错误。
根据本发明的一个方面,提供了一种电子设备,包含:多个从设备;和,主设备,所述主设备根据关于所述从设备处理由所述主设备发出的命令所花费的从设备工作时间的信息,来产生在与所述从设备的数据通信中所要求的时钟,并且所述主设备将所述时钟提供给所述从设备。
在这个方面,所述主设备可以产生调整到所述多个从设备中涉及通信错误的从设备的工作时间信息的时钟,从而从所述从设备接收确认(ACK)信号。
此外,所述主设备能够在从设备工作时间期间将用于接收所述ACK信号所要求的时钟保持在低电平,然后将所述时钟的电平从低变到高。
根据本发明的一个方面的所述电子设备还包含存储涉及通信错误的从设备工作时间信息的存储单元。
所述主设备检查串行时钟(SCL)线,从而确定通信错误是否已经发生。
而且,如果用于从所述从设备接收ACK信号所要求的时钟在对应于工作时间信息的时间期间被保持在低电平,则所述主设备确定所述通信错误已经发生。
此外,所述主设备检查所述SCL线预定次,从而确定所述通信错误是否已经发生。
根据本发明的另一个方面,提供了一种与多个从设备通信的主设备,所述主设备包含:数据产生单元,其产生要被提供给所述从设备的数据;时钟产生单元,其将为了提供所述数据所要求的所述时钟传递到所述从设备;和,控制单元,其控制所述时钟产生单元根据关于所述从设备处理由所述主设备发出的命令所花费的工作时间的信息来产生时钟。
在这个方面,所述控制单元可以控制所述时钟产生单元根据所述多个从设备中涉及通信错误的从设备的工作时间信息调整时钟,从而从所述从设备接收确认(ACK)信号。
此外,所述控制单元控制所述时钟产生单元在从设备工作时间内将用于接收所述ACK信号所要求的时钟保持在低电平,然后将所述时钟的电平从低变到高。
根据本发明的另一个方面的所述主设备还包含存储涉及通信错误的从设备的工作时间信息的存储单元。
根据本发明的一个方面的所述主设备还包含错误感测单元,其检查串行时钟(SCL)线,从而确定通信错误是否已经发生,并且将所述确定结果传递到所述控制单元。
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