[发明专利]显示数据接收电路和显示面板驱动器无效
申请号: | 200710128636.4 | 申请日: | 2007-07-09 |
公开(公告)号: | CN101101742A | 公开(公告)日: | 2008-01-09 |
发明(设计)人: | 米山辉 | 申请(专利权)人: | 恩益禧电子股份有限公司 |
主分类号: | G09G3/36 | 分类号: | G09G3/36 |
代理公司: | 中原信达知识产权代理有限责任公司 | 代理人: | 钟强;谷惠敏 |
地址: | 日本*** | 国省代码: | 日本;JP |
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摘要: | |||
搜索关键词: | 显示 数据 接收 电路 面板 驱动器 | ||
1.一种显示数据接收电路,包括:
时钟再生成电路,用于响应外部时钟信号,产生其频率是所述外部时钟信号的频率的整数倍的内部时钟信号;以及
串行/并行转换电路,用于与所述内部时钟信号同步地接收作为显示数据的串行数据信号,而且通过对所述串行数据信号执行串行/并行转换,产生并行数据信号,
其中配置所述串行/并行转换电路,以便既可以执行响应所述内部时钟信号的上升沿和下降沿之一接收所述串行数据信号的单沿操作,也可执行响应所述内部时钟信号的上升沿和下降沿二者接收所述串行数据信号的双沿操作;以及
其中配置所述时钟再生成电路,以便可以改变所述内部时钟信号的频率。
2.根据权利要求1所述的显示数据接收电路,
其中如果以第一传送速率将该显示数据送到显示数据接收电路,则该串行/并行转换电路执行单沿操作,而且将该内部时钟信号的频率设置为高达该外部时钟信号的频率的α倍;以及
其中如果以比第一传送速率低的第二传送速率将该显示数据送到显示数据接收电路,则该串行/并行转换电路执行双沿操作,而且将该内部时钟信号的频率设置为高达该外部时钟信号的频率的α/2倍。
3.根据权利要求1所述的显示数据接收电路,进一步包括:
控制电路,用于根据该串行数据信号的数据传送速率,响应从外部提供的控制信号,控制时钟生成电路和串行/并行转换电路,
其中响应该控制信号,控制电路控制改变串行/并行转换电路中的单沿操作和双沿操作,以及控制改变时钟生成电路产生的内部时钟信号的频率。
4.根据权利要求1所述的显示数据接收电路,进一步包括:
提取电路,用于从并行数据信号中提取模式改变数据;以及
控制电路,用于响应该模式改变数据,控制时钟生成电路和串行/并行转换电路,
其中响应该模式改变数据,控制电路控制改变串行/并行转换电路中的单沿操作和双沿操作,以及控制改变时钟生成电路产生的内部时钟信号的频率。
5.一种显示面板驱动器,包括:
显示数据接收电路,其接收用于发送显示数据的串行数据信号,而且产生对应于该串行数据信号的并行数据信号;以及
驱动电路,其响应该并行数据信号,驱动显示面板;
该显示数据接收电路包括:
时钟生成电路,用于响应外部时钟信号,产生其频率是外部时钟信号的频率的整数倍的内部时钟信号;以及
串行/并行转换电路,用于与内部时钟信号同步,接收串行数据信号,而且通过对串行数据信号执行串行/并行转换,产生并行数据信号,
其中配置该串行/并行转换电路,以便即能够执行响应该内部时钟信号的上升沿和下降沿之一接收该串行数据信号的单沿操作,也能够执行响应该内部时钟信号的上升沿和下降沿二者接收该串行数据信号的双沿操作;以及
其中配置该时钟生成电路,以便可以改变该内部时钟信号的频率。
6.根据权利要求5所述的显示面板驱动器,
其中如果以第一传送速率将该显示数据送到显示数据接收电路,则该串行/并行转换电路执行单沿操作,而且将该内部时钟信号的频率设置为高达该外部时钟信号的频率的α倍;以及
其中如果以比第一传送速率低的第二传送速率将该显示数据送到显示数据接收电路,则该串行/并行转换电路执行双沿操作,而且将该内部时钟信号的频率设置为高达该外部时钟信号的频率的α/2倍。
7.根据权利要求5所述的显示面板驱动器,进一步包括:
外部控制引脚,根据串行数据信号的数据传送速率,向该引脚提供控制信号;以及
控制电路,其根据该串行数据信号的数据传送速率,响应从外部提供的控制信号,控制时钟生成电路和串行/并行转换电路,
其中响应该控制信号,控制电路控制改变串行/并行转换电路中的单沿操作和双沿操作,以及控制改变时钟生成电路产生的内部时钟信号的频率。
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