[发明专利]输出控制电路无效
申请号: | 200710129196.4 | 申请日: | 2007-07-13 |
公开(公告)号: | CN101110588A | 公开(公告)日: | 2008-01-23 |
发明(设计)人: | 松冈大辅 | 申请(专利权)人: | 松下电器产业株式会社 |
主分类号: | H03K19/0175 | 分类号: | H03K19/0175;H03K19/0185 |
代理公司: | 北京市柳沈律师事务所 | 代理人: | 周少杰;黄小临 |
地址: | 日本*** | 国省代码: | 日本;JP |
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摘要: | |||
搜索关键词: | 输出 控制电路 | ||
技术领域
本发明涉及用于使用差分信号的接口的输出控制电路。
背景技术
电子装置中包括的CPU或集成电路的处理速度已经提高了。根据这个速度发展,电子装置中包括的电路之间、或电子装置之间的数据传递速率也已经提高,并且为了促进数据传递过程的性能,为传递数据的电路或那些电子装置提供了接口电路。在JP-A-2001-53598中公开了示例接口电路;在图13中显示了该公布中公开的接口电路发射器的电路图。
图13中显示的接口电路发射器包括:一个输入端;两个输出端OUT1和OUT2;两个串联连接的反相器INV1和INV2;以及两个输出晶体管,该输出晶体管的栅极连接到反相器INV1和INV2的输出端。在该发射器中,使输出晶体管根据由反相器INV1和INV2输出的信号的电压电平开启或关闭。并且与输出晶体管的开/关状态一致,通过输出端OUT1和OUT2选择性地输出信号。
专利文献1:JP-A-2001-53598
上述接口电路的工作速率根据差分信号之间的延迟差别受到限制。强加此限制是因为,当接口的操作周期比差分信号之间的延迟差别短时,可能产生信号错误,以及可能执行错误的操作。
差分信号之间的延迟差别受反相器的延迟时间影响。并且因为用于半导体制造过程的显微机械加工已经得到发展,所以晶体管功能的退化和制造差异趋于增大。因此,当受反相器的延迟时间影响的个别差别和个别差别的波动大时,差分信号之间的延迟差别也变大。在这种情况下,当接口电路在高速工作时,稳定工作是困难的。
用于解决这个问题的一种方法是增大反相器的晶体管的尺寸。但是,当晶体管尺寸增大时,这伴随着接口电路的规模的增大。因此,存在对具有小的电路规模的输出控制电路的需要,该电路在高速时仍然稳定工作。
发明内容
本发明的一个目的是提供具有小的电路规模的输出控制电路,该电路在高速时仍然稳定工作。
本发明提供一种输出控制电路,包含:
串联连接的第一反相器和第二反相器,用于以输入信号的翻转电压电平输出信号;
第一输出单元,对该单元,基于由第二反相器输出的信号的电压电平控制输出;
第三反相器,该反相器的输出连接到第一反相器的输出,用于以由第二反相器输出的信号的翻转电压电平输出信号;以及
第二输出单元,对该单元,基于由第一反相器输出的信号的电压电平和第三反相器输出的信号的电压电平控制输出。
本发明也提供输出控制电路,包含:
串联连接的第一反相器和第二反相器,用于以输入信号的翻转电压电平输出信号;
第一缓冲器,用于以由第一反相器输出的信号的电压电平输出信号;
第一输出单元,对该单元,基于由第一缓冲器输出的信号的电压电平控制输出;
第三反相器,该反相器的输出连接到第二反相器的输出,用于以由第一缓冲器输出的信号的翻转电压电平输出信号;以及
第二输出单元,对该单元,基于由第二反相器输出的信号的电压电平、和第三反相器输出的信号的电压电平控制输出。
根据输出控制电路,第一到第三反相器之一包括NAND门或NOR门,并且接收与输入信号不同的信号。
根据输出控制电路,第一到第三反相器之一、或第一缓冲器包括NAND门或NOR门,并且接收与输入信号不同的信号。
根据输出控制电路,使用CMOS反相器作为输出侧直接连接到第一输出单元的反相器,以及作为输出侧直接连接到第二输出单元反相器。
根据输出控制电路,第三反相器是三态反相器,对该反相器,基于控制信号控制输出阻抗。
根据输出控制电路,第三反相器是开关,基于控制信号控制其输出电流容量。
根据输出控制电路,在其输出直接连接到第一输出单元的的反相器、和其输出直接连接到第一输出单元的的反相器之间,安排第三反相器。
根据输出控制电路,其输出直接连接到第一输出单元的的反相器被安排,以便比其输出直接连接到第二输出单元的反相器、或第三反相器更接近第一输出单元。
根据输出控制电路,其输出直接连接到第二输出单元的的反相器被安排,以便比其输出直接连接到第一输出单元的反相器、或第三反相器更接近第二输出单元。
输出控制电路还包括:
连接到第一输出单元的输出端的第一焊盘;以及
连接到第二输出单元的输出端的第二焊盘,其中第一焊盘和第二焊盘相邻安排。
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