[发明专利]输出驱动装置及显示装置无效
申请号: | 200710136333.7 | 申请日: | 2007-07-24 |
公开(公告)号: | CN101114421A | 公开(公告)日: | 2008-01-30 |
发明(设计)人: | 大森哲郎;清家守;末永纯一 | 申请(专利权)人: | 松下电器产业株式会社 |
主分类号: | G09G3/28 | 分类号: | G09G3/28 |
代理公司: | 北京德琦知识产权代理有限公司 | 代理人: | 陆弋;宋志强 |
地址: | 日本大阪*** | 国省代码: | 日本;JP |
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摘要: | |||
搜索关键词: | 输出 驱动 装置 显示装置 | ||
1.一种输出驱动装置,其特征在于,该装置包括:
第1电流源和第2电流源,根据显示数据而导通on或断开off;
第1输入晶体管,具有源极、漏极和栅极,其源极与第1电位连接,其漏极通过所述第1电流源与第2电位连接,且所述漏极与所述栅极互相连接;
第2输入晶体管,具有源极、漏极和栅极,其源极与所述第1电位连接,其漏极通过所述第2电流源与所述第2电位连接,其栅极接收所述第1输入晶体管的栅极电压;
第1输出晶体管,具有源极、漏极和栅极,其源极与所述第1电位连接,其栅极接收所述第2输入晶体管的漏极电压;
第2输出晶体管,具有源极、漏极和栅极,其源极与所述第2电位连接,其漏极与所述第1输出晶体管的漏极连接,其栅极接收所述显示数据对应的控制信号。
2.根据权利要求1所述的输出驱动装置,其特征在于,
所述显示数据具有第1状态和第2状态;
所述显示数据为第1状态时,所述第1电流源导通,所述第2电流源断开,所述第2输出晶体管导通;
所述显示数据为第2状态时,所述第1电流源断开,所述第2电流源导通,所述第2输出晶体管断开。
3.根据权利要求1所述的输出驱动装置,其特征在于,
所述第1电流源为具有源极、漏极和栅极的第1电流源晶体管,其源极与所述第2电位连接,其漏极与所述第1输入晶体管的漏极连接,其栅极接收任意的恒定电压;
所述第2电流源为具有源极、漏极和栅极的第2电流源晶体管,其源极与所述第2电位连接,其漏极与所述第2输入晶体管的漏极连接,其栅极接收任意的恒定电压。
4.根据权利要求3所述的输出驱动装置,其特征在于,该装置包括:
第1二进制逻辑电路,将第3电位作为一个电源接收,同时,将第4电位作为另一个电源接收,根据所述显示数据对应的第1控制信号输出第3电位或者第4电位之中的任何一个,其中,所述第3电位用于使所述第1电流源晶体管中流过任意的恒定电流,所述第4电位用于使该第1电流源晶体管中流过O以上的任意电流;
第2二进制逻辑电路,将第5电位作为一个电源接收,同时,将第6电位作为另一个电源接收,根据所述显示数据对应的第2控制信号输出第5电位或者第6电位,其中,所述第5电位用于使所述第2电流源晶体管中流过任意的恒定电流,所述第6电位用于使该第2电流源晶体管中流过O以上的任意电流;
其中,
所述第1电流源晶体管的栅极接收所述第1二进制逻辑电路的输出;
所述第2电流源晶体管的栅极接收所述第2二进制逻辑电路的输出;
所述第3电位高于所述第4电位;
所述第5电位高于所述第6电位。
5.根据权利要求4所述的输出驱动装置,其特征在于,
所述第3电位和所述第5电位互为同电位;
所述第4电位和所述第6电位互为同电位。
6.根据权利要求4所述的输出驱动装置,其特征在于,该装置进一步包括:
恒流源;
偏置电压生成用晶体管,具有源极、漏极和栅极,其源极与所述第2电位连接,其漏极通过所述恒流源与所述第1电位连接,且所述漏极与所述栅极互相连接;
电流缓冲器电路,用于放大所述偏置电压生成用晶体管的栅极电压,将放大的栅极电压作为所述第3电位和所述第5电位输出。
7.根据权利要求4所述的输出驱动装置,其特征在于,该装置进一步包括:
恒流源;
偏置电压生成用晶体管,具有源极、漏极和栅极,其源极与所述第2电位连接,其漏极通过所述恒流源与所述第1电位连接,且所述漏极与所述栅极互相连接;
电流缓冲器电路,用于放大所述偏置电压生成用晶体管的栅极电压,将放大的栅极电压作为所述第4电位和所述第6电位输出。
8.根据权利要求4所述的输出驱动装置,其特征在于,
所述第1控制信号和所述第2控制信号具有第1状态和第2状态;
所述第1二进制逻辑电路,当所述第1控制信号为第1状态时,输出所述第4电位,当所述第1控制信号为第2状态时,输出所述第3电位;
所述第2二进制逻辑电路,当所述第2控制信号为第1状态时,输出所述第6电位,当所述第2控制信号为第2状态时,输出所述第5电位。
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