[发明专利]信号处理电路及信号处理方法有效

专利信息
申请号: 200710145698.6 申请日: 2002-02-10
公开(公告)号: CN101127228A 公开(公告)日: 2008-02-20
发明(设计)人: 真下著明 申请(专利权)人: 蒂雅克株式会社
主分类号: G11B20/10 分类号: G11B20/10;G11B20/24;H03K5/1252
代理公司: 北京集佳知识产权代理有限公司 代理人: 逯长明
地址: 日本东京都武*** 国省代码: 日本;JP
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摘要:
搜索关键词: 信号 处理 电路 方法
【权利要求书】:

1.一种信号处理电路,是从输入脉冲信号除去噪声成分,得输出脉冲信号,其特征在于:包括:

一栅极部,供给该输入脉冲信号和时脉,按照该输入脉冲信号,输出时脉;

一计数部,是按照该输出脉冲信号,清除该输出计数值,计数从该栅极输出的时脉;

一保持部,按照该计数部的计数值,使该输出脉冲信号置位或重置。

2.如权利要求1所述的信号处理电路,其特征在于:该栅极部,包括:

一第一栅极电路,是在输入脉冲信号的高准位期间,输出该时脉;以及

一第二栅极电路,是在该输入脉冲信号的低准位期间,输出该时脉;

计数部,包括:

一第一计数器,是在输出脉冲信号的低准位期间,计数,从该第一栅极电路的时脉;以及

一第二计数器是在该输出脉冲信号的高准位期间,计数,从该第二栅极电路的时脉;

该保持部,在该第一计数器的计数值和该第二计数器的计数值,达到预设计数值时进行置位或重置。

3.如权利要求1或2所述的信号处理电路,其特征在于:包括:

一第一迟延电路,使该输出脉冲信号,迟延所定的预设期间;

一第二迟延电路,使在该第一迟延电路,迟延的输出,迟延所定的预设期间;

一计数器,由该第二迟延电路的输出,加以清除,计数该时脉;以及

一锁存电路,由该第一迟延电路,锁存该计数器的计数值。

4.一种信号处理方法,从输入脉冲信号,除去噪声成分,使输出脉冲信号输出,其特征在于:包括:

第一顺序,供给该输入脉冲信号及时脉,按照输入脉冲信号,输出该时脉;

第二顺序,按照该输出脉冲信号,清除该输出计数值,计数该第一顺序的输出时脉,输出计数值;以及

第三顺序,按照在该第二顺序所得的该计数值,使该输出脉冲信号置位或重置。

5.如权利要求4所述的信号处理方法,其特征在于:

该第一顺序在该输入脉冲信号的高准位期间,输出该时脉,同时,在该输入脉冲信号的低准位期间,输出该时脉;

该第二顺序,在该输出脉冲信号的低准位期间,计数供给的时脉,同时,在该输出脉冲的高准位期间,计数供给的时脉;以及

该第三顺序,在该第二顺序所计数的低准位期间的计数值,及高准位期间的计数值达到所定的预设计数值时,进行置位或重置。

6.如权利要求4或5所述的信号处理方法,其特征在于:包括:

第四顺序,使该输出脉冲信号,迟延所定的预设期间;

第五顺序,使在该第四顺序迟延的信号,迟延所定的预设期间;以及

第六顺序,由该第四顺序所迟延的信号,锁存该时脉的计数值,由该第五序顺所迟延的信号,清除该时脉的计数值。

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