[发明专利]一种快速处理报文的方法及装置无效
申请号: | 200710145758.4 | 申请日: | 2007-09-05 |
公开(公告)号: | CN101159729A | 公开(公告)日: | 2008-04-09 |
发明(设计)人: | 田浩 | 申请(专利权)人: | 杭州华三通信技术有限公司 |
主分类号: | H04L29/02 | 分类号: | H04L29/02;H04L12/56 |
代理公司: | 北京挺立专利事务所 | 代理人: | 龚家骅 |
地址: | 310053浙江省杭州市高新技术产业*** | 国省代码: | 浙江;33 |
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摘要: | |||
搜索关键词: | 一种 快速 处理 报文 方法 装置 | ||
技术领域
本发明涉及通信技术领域,尤其涉及一种快速处理报文的方法及装置。
背景技术
现有技术中,不同局域网之间通过互联网通信,如图1所示,局域网A和局域网B的网关负责报文处理。然而,数据报文在互联网中通常不会是简单的直接传递,而是会经过各种特殊的处理。比如考虑到互联网的不安全性,需要在源端对报文进行加密并在目的端进行解密;或者在源端对报文进行压缩,并在目的端进行解压缩等。这种对报文的处理通常有多种实现方式,比如通过软件代码实现对报文的处理,这相当于把所有的工作都交给了处理器处理,这将给处理器带来极大的负担。
为了减轻处理器的负担,目前业界也有采用通过硬件实现对前述报文的处理工作,相当于起到协处理器的功能,通过此种实现方式,系统在收到报文后,不是交给处理器进行报文处理,而是把报文交给协处理器单元,进行加、解密或其他处理工作,在处理完成以后再通知处理器把已完成处理的数据报文取走。由于在现有技术中,路由器或三层交换机系统主要是基于PCI(Peripheral Component Interconnect,外部组件互连)或PCI-X(PCI-eXpress,PCI扩展)总线技术,如图2所示,通过处理器加北桥的方式或直接选用SOC(System On Chip,系统芯片)处理器,并借由PCI或PCI-X总线与各种设备相连,比如PCI桥片、网卡或者是通过南桥连接更为普通的总线设备,如BootROM、CPLD(Complex Programmable Logic Device,复杂可编程逻辑器件)等,处理器外挂的DDR(Double Data Rate,双倍数据速率)SDRAM(Synchronous Dynamic Random Access Memory,同步动态随机接入存储器)或DDR2 SDRAM(第二代双倍速率同步动态随机存储器)内存条用于系统软件运行及暂存。而为完成某一特定业务处理功能的协处理器芯片则通常是作为一个设备挂在PCI或PCI-X总线上的。
下面再结合图2说明上述现有技术关于报文加密的协处理器处理流程,包括以下步骤:
1、业务端口(如网口)在收到报文后将数据存入系统为其分配的指定内存空间,通常存在DIMM(Dual In-line Memory Module,双面引脚内存条)中,处理器通过双倍速总线存取数据。
2、处理器首先对报文进行处理,例如对于转发业务,需要确定其目标地址,也就是出端口。
3、如果该目标地址属于不安全区域,需要报文加密,处理器会通过PCI/PCI-X总线通知协处理器,指定内存空间存在待加密报文。
4、协处理器通过其自身的DMA(Direct Memory Access,直接内存访问)控制器将报文从内存中取走,并进行相应的加密处理。
5、协处理器通过其自身的DMA控制器将已完成处理的报文写入指定内存空间,并上报中断通知处理器报文已处理完毕。
6、处理器响应中断,并通知目的端口将已完成处理报文取走并发送或进行其他处理。
从上述协处理器处理的流程中,已看到为完成对数据报文的处理,无论是对数据的读取还是写入,会多次使用PCI这种低速、低带宽的总线(即使使用PCI-X总线,总线带宽依然不理想,且设计更为复杂)。因此,这种方案虽然能够在一定程度上将处理器从繁忙的工作中解脱出来,但随着当前互联网流量呈几何级倍数的增长,如果仍然使用PCI这种低速、低带宽的总线作为设备的接口,将必然使得协处理器件的处理能力成为新的系统瓶颈。另外,由于报文处理的多样性,比如加解密、压缩解压缩、协议处理等,为适应不同场合的应用,有可能需要各种各样的协处理器,而如果事先在路由器等交换投备上添加处理各种业务的协处理器,一旦实际应用不需要,则会造成成本的浪费;而如果在某款交换设备上只设置一种协处理器的接口,一旦需要处理其他报文业务,由于无法对相应的协处理器进行扩展,则会造成该交换设备的通用性不强等不足。
发明内容
本发明提供了一种协处理方法及装置,以提高协处理总线带宽,进而提升系统性能。
本发明提供了一种处理装置,应用于对接收的数据快速进行相应业务的处理,包括处理器、协处理器和存储器,所述处理器、协处理器和存储器分别通过高速总线通信;
所述处理器,在接收到需要进行业务处理的数据时,将该待处理的数据存储到存储器中,并通知所述协处理器对待处理数据进行相应的业务处理;
存储器,分别与所述处理器和协处理器连接,用于存储前述待处理数据,供所述协处理器调用;
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