[发明专利]在存储器控制器中产生逻辑上专用的读和写通道的机制有效
申请号: | 200710170165.3 | 申请日: | 2007-09-25 |
公开(公告)号: | CN101202102A | 公开(公告)日: | 2008-06-18 |
发明(设计)人: | R·苏巴什钱德拉博斯;A·莫汉蒂;R·阿加瓦尔 | 申请(专利权)人: | 英特尔公司 |
主分类号: | G11C7/22 | 分类号: | G11C7/22;G06F3/06 |
代理公司: | 中国专利代理(香港)有限公司 | 代理人: | 曾祥夌;陈景峻 |
地址: | 美国加利*** | 国省代码: | 美国;US |
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摘要: | |||
搜索关键词: | 存储器 控制器 产生 逻辑 专用 通道 机制 | ||
1.一种包含存储器控制器的系统,所述存储器控制器通过第一专用命令时段来将读命令调度到帧,并通过第二或第三专用命令时段来将写命令和对应的数据调度到帧。
2.如权利要求1所述的系统,其中,将第一读命令和第一写命令调度到第一帧中。
3.如权利要求1所述的系统,其中,所述存储器控制器包括:
将读命令调度到第一专用命令时段上的读命令调度器;以及将写命令调度到第二或第三专用命令时段上的写命令调度器。
4.如权利要求3所述的系统,其中,所述存储器控制器还包括:
耦合到读命令调度器的读序列;以及
耦合到写命令调度器的写序列。
5.如权利要求4所述的系统,其中,所述存储器控制器还包括解决逻辑,用于解决执行中的存储器命令与来自读和写序列的命令之间的冲突。
6.如权利要求5所述的系统,其中,所述解决逻辑将已解决的命令转发到读命令调度器和写命令调度器中。
7.如权利要求2所述的系统,其中,所述存储器控制器在传送包含写命令和对应的数据的帧之后,确认写响应。
8.如权利要求7所述的系统,其中,所述存储器控制器一接收到同步帧的响应状态就确认写响应。
9.如权利要求7所述的系统,其中,所述存储器控制器一接收到对应于在第一帧中与写命令一起传送的读命令的数据就确认写响应。
10.一种方法,包括:
存储器控制器通过专用于读命令的第一命令时段来将第一读命令调度到第一帧;
存储器控制器通过第一命令时段来将第二读命令调度到第二帧;以及存储器控制器通过专用于写命令的第二命令时段或第三命令时段,来将第一写命令和对应的数据调度到第二帧。
11.如权利要求10所述的方法,还包括:
将第一帧传送到存储器设备;以及
将第二帧传送到存储器设备。
12.如权利要求11所述的方法,还包括:
从所述存储器设备接收对应于第一读命令的第一组帧;以及
在接收所述第一组帧之后,立刻从所述存储器设备接收对应于第二读命令的第二组帧。
13.一种存储器控制器,包括:
命令时段,用于将一个或多个命令插入到一个帧中;
读命令调度器,用于通过第一专用命令时段来将读命令调度到帧;以及
写命令调度器,用于通过第二或第三专用命令时段来将写命令和对应的数据调度到帧。
14.如权利要求13所述的存储器控制器,还包括:
耦合到读命令调度器的读序列;以及
耦合到写命令调度器的写序列。
15.如权利要求14所述的存储器控制器,还包括解决逻辑,用于解决执行中的存储器命令与来自读和写序列的命令之间的冲突。
16.如权利要求15所述的存储器控制器,其中,所述解决逻辑将已解决的命令转发到读命令调度器和写命令调度器。
17.如权利要求13所述的存储器控制器,其中,所述存储器控制器在传送包含写命令和对应的数据的帧之后,确认写响应。
18.一种系统,包括:
完全缓冲DIMM存储器设备;以及
存储器控制器,与所述完全缓冲DIMM存储器设备连接,用于通过第一专用命令时段来将读命令调度到帧,以及用于通过第二或第三专用命令时段来将写命令和对应的数据调度到帧,并将这些帧传送到完全缓冲DIMM存储器设备。
19.如权利要求18所述的系统,其中,将第一读命令和第一写命令调度到第一帧中。
20.如权利要求18所述的系统,其中,所述存储器控制器包括:
将读命令调度到第一专用命令时段上的读命令调度器;以及将写命令调度到第二和第三专用命令时段上的写命令调度器。
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