[发明专利]频率同步装置,频率同步方法及使用其的频率产生装置无效
申请号: | 200710186065.X | 申请日: | 2007-11-13 |
公开(公告)号: | CN101436856A | 公开(公告)日: | 2009-05-20 |
发明(设计)人: | 金忠达 | 申请(专利权)人: | 华硕电脑股份有限公司 |
主分类号: | H03L7/00 | 分类号: | H03L7/00;H03L7/06;H03L7/08;H03L7/18 |
代理公司: | 北京市柳沈律师事务所 | 代理人: | 黄小临 |
地址: | 中国台*** | 国省代码: | 中国台湾;71 |
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摘要: | |||
搜索关键词: | 频率 同步 装置 方法 使用 产生 | ||
技术领域
本发明是关于一种频率同步装置,且特别是关于一种将不同频率产生器所产生的频率信号同步的装置。
背景技术
传统的频率产生器为将石英振荡器所提供的参考频率信号作为输入源,透过其内部锁相回路电路及除频电路而产生不同频率的频率信号,以供系统运作。然而,在电子或计算机系统,频率信号是否同步,是非常重要的。因此,锁相回路(phase-locked loop,PLL)便是一种被广泛使用的同步电路。
图1所示为频率产生器的示意图。请参照图1,频率产生器100包括锁相回路120、除频器111、112、及逻辑控制单元150。逻辑控制单元150与锁相回路120电性连接,以控制锁相回路120的操作。锁相回路120分别与石英振荡器140、除频器111、112电性连接。锁相回路120接收石英振荡器140所提供的参考频率信号fR,并且据以产生输出信号f0。
对于一个电子系统而言,其通常需要不同频率的频率信号,以供各种不同类型的装置能正常运作。例如:中央处理单元(CPU)的操作频率便与内存模块的操作频率不同。因此,在一般的频率产生器100中,会配置多个除频器,例如除频器111和112,来将锁相回路120所产生的输出信号f0予以除频,以产生所需的频率的频率信号,例如频率信号fD1、fD2,其中频率信号fD1、fD2的频率可以相同,也可以不同。
然而,单一个锁相回路所能扇出的信号个数毕竟有限。换句话说,频率产生器100所能输出的频率信号是有限的。当系统所需的频率信号超过频率产生器100所能提供时,则可以藉由耦接方式再配置另一频率产生器,例如:频率产生器130,以提供额外需要的频率信号。然而,频率产生器100所提供的频率信号(例如:频率信号fD1、fD2)若再经过另一频率产生器的除频器处理,则会产生信号延迟现象。也就是说,频率产生器100所产生的频率信号与上述另一频率产生器所提供的频率信号不同步。如此,将可能使得电子系统产生误动作。
发明内容
因此,本发明提供一种频率同步装置、频率同步方法及使用其的频率产生装置,其可轻易地使多个独立运作的频率产生器所输出的各频率信号彼此同步。
本发明提出一种频率同步装置适于同步第一频率产生器及第二频率产生器所分别产生的第一频率信号及第二频率信号。频率同步装置包括延迟锁定回路以及锁相回路。延迟锁定回路接收第一频率信号与第二频率信号,并依据二者间相位的关系而产生第一参考信号。锁相回路耦接延迟锁定回路,以接收第一参考信号,并产生第二参考信号给第二频率产生器,其中第二参考信号符合第二频率产生器的输入要求。
本发明另提出一种频率产生装置,用于产生多个同步的频率信号。频率产生装置包括第一频率产生器、第二频率产生器以及频率同步装置。第一频率产生器依据参考频率信号,产生第一频率信号。第二频率产生器依据第一参考信号,产生第二频率信号。频率同步装置耦接第一频率产生器及第二频率产生器,接收第一频率信号及第二频率信号,其依据两者间相位的关系进行相位及频率锁定,并产生第一参考信号。
从另一观点来看,本发明另提出一种频率同步方法。首先,接收第一频率信号和第二频率信号。接着,比较第一频率信号与第二频率信号的相位差,而产生第一参考信号。而依据第一参考信号来产生第二频率信号,以使第一频率信号和第二频率信号同步。
本发明因采用将其一频率产生器输出的频率信号,经同步处理后作为另一频率产生器的输入源的方式,得以使两频率产生器所提供的频率信号同步。而此频率同步装置主要为依据两频率信号之间相位的关系,控制延迟锁定回路及锁相回路进行相位及频率锁定。此外,倘若系统需要多组相同的频率信号时,将频率同步装置桥接两频率产生器,便可使二者输出同步的频率信号。
为让本发明的上述和其它目的、特征和优点能更明显易懂,下文特举本发明的较佳实施例,并配合所附图式,作详细说明如下。
附图说明
图1所示为频率产生器的示意图。
图2A所示为本发明的一实施例的频率产生装置的示意图。
图2B所示为本发明实施例图2A中频率产生器的示意图。
图2C所示为本发明实施例图2A中频率同步装置的示意图。
图2D所示为本发明实施例图2C中延迟锁定回路的示意图。
图3所示为本发明的一实施例的频率同步方法的流程图。
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