[发明专利]通用序列总线的频率同步装置及方法有效
申请号: | 200710198748.7 | 申请日: | 2007-12-12 |
公开(公告)号: | CN101458675A | 公开(公告)日: | 2009-06-17 |
发明(设计)人: | 王明坤;胡闵雄;林春安 | 申请(专利权)人: | 盛群半导体股份有限公司 |
主分类号: | G06F13/42 | 分类号: | G06F13/42 |
代理公司: | 北京律诚同业知识产权代理有限公司 | 代理人: | 梁 挥;祁建国 |
地址: | 台湾省*** | 国省代码: | 中国台湾;71 |
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摘要: | |||
搜索关键词: | 通用 序列 总线 频率 同步 装置 方法 | ||
1.一种通用序列总线的频率同步装置,其特征在于,应用于一从属端装置,并且以一主机端系统所产生的讯框起始信号来作为一参考时脉,该频率同步装置包括:
一除频器,接收一高频信号,用以将该高频信号经一可变除频倍数的除频而产生一锁频信号;
一计数单元,具有一预设脉波数量,用以检测该锁频信号于该参考时脉下的脉波数与该预设脉波数量之间的误差,以形成一检测误差值;
一运算单元,记录该检测误差值,并与前一参考时脉下已暂存的检测误差值相加以产生一误差调整值;及
一调整单元,接收该误差调整值,并对应产生一分摊调整值,该分摊调整值通过将数量为该误差调整值的脉波数的周期时间平均分配到该预设脉波数量中获得,以控制该除频器于下一个该参考时脉时,每隔该分摊调整值便依据该误差调整值来调整该可变除频倍数;
从而,上述频率同步装置通过回授控制以使该从属端装置得以接收该锁频信号而与该主机端系统形成频率同步。
2.根据权利要求1所述的通用序列总线的频率同步装置,其特征在于,所述的检测误差值及该误差调整值为正数、负数或零。
3.根据权利要求1所述的通用序列总线的频率同步装置,其特征在于,所述的运算单元进一步包含:
一调整暂存器,用以接收该检测误差值,并且与一前一次已暂存的检测误差值进行运算及回存后,产生该误差调整值;及
一误差累加器,用以累积记录该检测误差值,并且当该累积记录的检测误差值超过一临界值时,则执行一消除累积误差的程序。
4.根据权利要求3所述的通用序列总线的频率同步装置,其特征在于,所述的消除累积误差的程序将该累积记录的检测误差值除以该临界值以获得一分摊脉波量,以于该调整暂存器所产生的该误差调整值中增加一个该分摊脉波量,进而使该调整单元得以依据增加后的该误差调整值来对应产生该分摊调整值。
5.根据权利要求4所述的通用序列总线的频率同步装置,其特征在于,所述的分摊脉波量分别于不同的该参考时脉下进行增加,直至该累积记录的检测误差值小于该临界值。
6.根据权利要求4所述的通用序列总线的频率同步装置,其特征在于,所述的消除累积误差的程序进一步执行一补偿程序以先暂存该分摊脉波量,而于下一个该参考时脉所产生的该检测误差值中增加一个该分摊脉波量,使该调整暂存器得以接收增加后的该检测误差值,并且与一目前已暂存的检测误差值进行运算及回存。
7.根据权利要求1所述的通用序列总线的频率同步装置,其特征在于,所述的调整单元进一步包含:
一对应单元,用以接收该误差调整值,并依据该误差调整值对应产生该分摊调整值;及
一信号产生器,连接该对应单元,用以计数下一个该参考时脉下的脉波数每隔该分摊调整值时,便产生一控制信号,以控制该除频器依据该误差调整值而调整该可变除频倍数;其中,若误差调整值为零,则可变除频器无需调整;若误差调整值为负数,则调高可变除频器的倍数;若误差调整值为正数,则调低可变除频器的倍数。
8.一种通用序列总线的频率同步方法,其特征在于,应用于一从属端装置,并且以一主机端系统所产生的讯框起始信号来作为一参考时脉,该频率同步方法的步骤包括:
a、将一高频信号经由一除频器的一可变除频倍数的除频以产生一锁频信号;
b、检测该锁频信号于该参考时脉下的脉波数与一预设脉波数量之间的误差,以形成一检测误差值;
c、记录该检测误差值,并与前一参考时脉下已暂存的检测误差值相加以产生一误差调整值;及
d、依据该误差调整值对应产生一分摊调整值,该分摊调整值通过将数量为该误差调整值的脉波数的周期时间平均分配到该预设脉波数量中获得,进而控制该除频器于下一个该参考时脉时,每隔该分摊调整值便依据该误差调整值来调整该可变除频倍数;
通过重复上述a~d步骤,以形成回授控制而使该从属端装置得以接收该锁频信号而与该主机端系统形成频率同步。
9.根据权利要求8所述的通用序列总线的频率同步方法,其特征在于,所述的检测误差值及该误差调整值为正数、负数或零。
10.根据权利要求8所述的通用序列总线的频率同步方法,其特征在于,在记录该检测误差值的步骤中,进一步包含:将该检测误差值与一前一次已暂存的检测误差值进行运算及回存后,以产生该误差调整值。
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