[发明专利]数据驱动器以及使用它的显示装置无效
申请号: | 200710198813.6 | 申请日: | 2007-12-07 |
公开(公告)号: | CN101197103A | 公开(公告)日: | 2008-06-11 |
发明(设计)人: | 中村一雄 | 申请(专利权)人: | 恩益禧电子股份有限公司 |
主分类号: | G09G3/20 | 分类号: | G09G3/20;G09G3/36;G11C19/00 |
代理公司: | 中原信达知识产权代理有限责任公司 | 代理人: | 关兆辉;陆锦华 |
地址: | 日本*** | 国省代码: | 日本;JP |
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摘要: | |||
搜索关键词: | 数据 驱动器 以及 使用 显示装置 | ||
1.一种数据驱动器电路,包括:
移位寄存器部分,其包含级联连接的触发器,并且被配置以通过所述触发器与时钟信号同步地移位脉冲信号,其中所述触发器被以N个触发器为单位集合成M个部分移位寄存器,并且以部分移位寄存器为单位复位所述M个部分移位寄存器;其中,N是等于或大于2的整数,M是等于或大于2的整数,以及
控制电路,其被配置以响应来自所述移位寄存器部分的移位后的脉冲信号来接收显示数据,并且根据显示数据驱动显示部分的数据线以在显示部分上显示该显示数据。
2.如权利要求1所述的数据驱动器电路,其中,响应于复位信号复位所述M个部分移位寄存器中的第一个,并且
响应于提供给在所述部分移位寄存器之前的所述M个部分移位寄存器之一的所述脉冲信号或所述移位后的脉冲信号来复位除了所述第一个部分移位寄存器之外的所述M个部分移位寄存器的每一个。
3.如权利要求1或2所述的数据驱动器电路,其中,所述移位寄存器部分包括:
时钟控制电路,其被配置以与所述时钟信号同步地产生移位时钟信号;以及
移位寄存器电路,其包含所述触发器并被配置以通过所述触发器与所述移位时钟信号同步地移位脉冲信号,并且
所述时钟控制电路将所述移位时钟信号输出到所述M个部分移位寄存器,以便所述M个部分移位寄存器中的每一个在水平周期中的第一周期期间工作并且在水平周期中的剩余周期期间复位。
4.如权利要求3所述的数据驱动器电路,其中,所述时钟控制电路输出所述移位时钟信号,该移位时钟信号含有分别对应于所述M个部分移位寄存器的部分移位时钟信号,并且
所述M个部分移位寄存器的每一个与相应的部分移位时钟信号同步地对所述脉冲信号或者所述移位后的脉冲信号进行移位。
5.如权利要求4所述的数据驱动器电路,其中,当所述脉冲信号或者所述移位后的脉冲信号被提供给在与所述部分移位时钟信号相对应的所述部分移位寄存器之前的所述M个部分移位寄存器的其中一个时,所述时钟控制电路启动输出每一个所述部分移位时钟信号。
6.如权利要求4所述的数据驱动器电路,其中,当从紧接与所述部分移位时钟信号相对应的所述部分移位寄存器的所述M个部分移位寄存器的其中一个输出所述脉冲信号或者移位后的脉冲信号时,所述时钟控制电路停止输出每一个所述部分移位时钟信号。
7.一种显示装置,包括:
显示面板,其具有栅极线、数据线以及被设置在所述栅极线和所述数据线的交叉点的像素;
栅极驱动器,其被配置以顺序驱动所述栅极线;以及
数据驱动器,其被配置以在每个水平周期中根据显示数据驱动所述数据线,
其中,所述数据驱动器包括级联连接的K个数据驱动器电路,K是等于或大于2的整数,并且
每个所述数据驱动器电路包括:
移位寄存器部分,其包含级联连接的触发器并且被配置以通过所述触发器与时钟信号同步地移位脉冲信号,其中所述触发器被以N个触发器为单位集合成M个部分移位寄存器,并且以部分移位寄存器为单位复位所述M个部分移位寄存器,其中N是等于或大于2的整数,M是等于或大于2的整数;以及
控制电路,其被配置以响应来自所述移位寄存器部分的所述移位后的脉冲信号来接收显示数据的相应部分并且根据该显示数据的相应部分驱动相应的所述一条数据线。
8.如权利要求7所述的显示装置,其中,响应复位信号复位所述M个部分移位寄存器中的第一个,并且
响应于提供给在所述部分移位寄存器之前的所述部分移位寄存器的其中一个的所述脉冲信号或所述移位后的脉冲信号来复位所述第一个部分移位寄存器之外的所述M个部分移位寄存器的每一个。
9.如权利要求7或8所述的显示装置,其中所述移位寄存器部分包括:
时钟控制电路,其被配置以与所述时钟信号同步地产生移位时钟信号;以及
移位寄存器电路,其包含所述触发器并且被配置以通过所述触发器与所述移位时钟信号同步地移位所述脉冲信号,并且
所述时钟控制电路将所述移位时钟信号输出到所述M个部分移位寄存器,以便所述M个部分移位寄存器中的每一个在水平周期中的第一周期期间工作并且在该水平周期中的剩余周期期间复位。
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