[发明专利]一种发射机和在该发射机中进行时序控制的方法有效

专利信息
申请号: 200710304113.0 申请日: 2007-12-25
公开(公告)号: CN101188595A 公开(公告)日: 2008-05-28
发明(设计)人: 张辉;王西强;孟斐;钱炜;蒋科 申请(专利权)人: 北京创毅视讯科技有限公司
主分类号: H04L27/26 分类号: H04L27/26;H04J11/00
代理公司: 北京安信方达知识产权代理有限公司 代理人: 龙洪;霍育栋
地址: 100084北京市海淀区*** 国省代码: 北京;11
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摘要:
搜索关键词: 一种 发射机 进行 时序 控制 方法
【说明书】:

技术领域

发明涉及无线通信领域,尤其涉及一种发射机和在该发射机中进行时序控制的方法。

背景技术

现有的发射机基本架构如图1所示,数据流按照箭头所示方向传输。发射机传输数据以TS(时隙)为单位,以每个时隙25毫秒为例,每秒可传输40个时隙。每个时隙中含有保护间隔、循环前缀、以及OFDM符号等,其数目和出现时间均需要严格控制,因此时序控制是发射机的关键;所述时序控制是指对发射机中依次处理数据的模块收发数据的时间点进行控制,使这些模块能够依照数据处理的顺序按时接收数据,并且保证这些模块向其下一级模块发送数据时,其下一级模块中的数据已经发往再下一级的模块,以免造成数据的冲突。

如图2所示,现有发射机时序控制模块采用Global timing(全局时序控制)模式。Global timing模块按照输入时钟信号进行计数,计数器分别按照时隙和秒进行清零,发射机中其它每个与时序紧密相关的模块处理数据的模块,其接收和发送数据的时间点均由Global timing精确给出。

现有方案的缺陷在于:实现复杂度过度集中;由于每个模块的时序各有不同,因此Global timing模块本身必然是多个时序控制子模块的结合,实现复杂度较高。另外,所有模块的时序控制功能都由Global timing模块来完成,一旦Global timing模块出现错误或发生故障,将导致整个发射机的时序混乱,可靠性比较差。再者,除Global timing模块之外的各个模块时序控制相对独立,结构比较零散;在时序控制上,可以看到每个模块的时序控制信号实际都由Global timing给出,与其联系紧密。但各模块之间联系松散,时序结构上不成为一个整体,这和发射机本身对时序的精确要求不符;如果出现问题,很难追本溯源地找到问题,而将所有矛盾集中于Global timing模块中。最后,由于Global timing模块需要其它各模块接收数据的时间点,因此与其它各模块要相互传递大量的时序控制信号,占用了发射机的系统资源。

发明内容

本发明要解决的技术问题是提供一种发射机和在该发射机中进行时序控制的方法,将原本高度集中的时序控制分散到发射机的各组成部分中,降低了实现的复杂度,并且节省了一定的系统资源。

为了解决上述结束,本发明提供了一种发射机,包括接口模块、组帧模块以及数据处理流水线;所述数据处理流水线为依次相连的缓存器或字节交织器、编码器、比特交织器、星座映射模块、OFDM符号构成模块及快速逆傅立叶变换模块IFFT;其中缓存器或字节交织器和接口模块相连;IFFT和组帧模块相连;

所述数据处理流水线上的每个模块及接口模块均用于按照本模块的时序控制信号将数据发给后续模块;

所述组帧模块用于对接收到的数据进行组帧并输出。

进一步的,所述本模块的时序控制信号包括本模块定时设备的到时信号,或是本模块所收到的请求数据的信号。

进一步的,当所述时序控制信号为本模块定时设备的到时信号时:

所述数据处理流水线上每个模块及接口模块中均包括一定时设备,用于在到达定时时间后发出到时信号指示本模块向后续模块发送数据;并在每次本模块收到数据时重新启动。

进一步的,所述定时设备为定时器、或计数器、或计时器;

所述定时设备的定时时间为本模块按最差处理能力处理完一批数据所需时间、和其后续模块定时时间中较长的那个时间;

所述一批数据为本模块每次输出的数据量。

进一步的,当所述时序控制信号为本模块所收到的请求数据的信号时:

所述组帧模块用于当本模块内存中有足够大的空余空间时,向所述IFFT请求数据;

所述数据处理流水线中的每个模块及接口模块均用于在收到后续模块请求数据的信号后将本模块置于被请求状态;还用于在被请求状态下,当本模块中有足够多的已处理数据时将数据发送给后续模块,并在发送后将本模块置于非被请求状态;

所述数据处理流水线中的每个模块还用于当本模块中有足够大的空余存储空间时,向前一级模块请求数据;

所述数据处理流水线中的每个模块及接口模块在刚上电时均为被请求状态;

所述足够多是指本模块中已处理数据量大于或等于本模块每次输出的数据量;所述足够大是指本模块中空余存储空间的大小大于或等于前一级模块每次输出的数据量。

进一步的,所述数据处理流水线中所有模块及接口模块的总处理能力大于或等于组帧模块的处理能力。

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