[实用新型]一种高速可配置扩展SPI总线

权利要求书

1.一种高速可配置扩展SPI总线，它有至少一个主模块及至少一个从模块，以及SPI总线中的SCLK时钟输出信号线、MOSI数据线、MISO数据线、SS选通信号线以及配置信号线SCFG，其特征是：所述主模块内设有可变长总线发送/接收器器FPGA/CPLD，从模块内设有总线接收/发送器FPGA/CPLD，它们共同组成总线配置收发器；主模块可变长总线发送/接收器FPGA/CPLD通过串行级联配置信号线SCFG与其中一个从模块的总线接收/发送器FPGA/CPLD连接，该从模块总线接收/发送器FPGA/CPLD则通过配置信号线SCFG与其它从模块总线接收/发送器FPGA/CPLD相互串联，通过通信协议和可编程逻辑设计进行数据报文的可变长度传输和从模块的柔性在线配置；同时主模块的SPI总线还通过屏蔽双绞线与其他从模块连接，并对SPI总线信号进行差分处理，实现数据包的高速长距离的一主多从通讯。

2.根据权利要求1所述的高速可配置扩展SPI总线，其特征是：所述可变长总线发送/接收器FPGA/CPLD包括报文长度寄存器、发送计数器，发送计数器接收发送使能信号和计数时钟信号，报文长度寄存器、发送计数器输出端接比较器，比较器输出端接SCLK时钟输出信号线，计数时钟信号还分两路，一路接SCLK时钟输出信号线，另一路接串行发送器输入端，其输出端接MOSI数据线。

3.根据权利要求1所述的高速可配置扩展SPI总线，其特征是：所述总线接收/发送器FPGA/CPLD包括控制信息接收器和数据信息接收器；主板和每个子板各有至少一个控制信息接收器和一个数据信息接收器。