[发明专利]尖峰噪声消除电路及使用该尖峰噪声消除电路的数字系统、IIC总线无效
| 申请号： | 200780037814.0 | 申请日： | 2007-10-05 |
| 公开（公告）号： | CN101523722A | 公开（公告）日： | 2009-09-02 |
| 发明（设计）人： | 衣笠教英;太田幸 | 申请（专利权）人： | 松下电器产业株式会社 |
| 主分类号： | H03K5/1252 | 分类号： | H03K5/1252 |
| 代理公司： | 永新专利商标代理有限公司 | 代理人： | 陈 萍 |
| 地址： | 日本*** | 国省代码： | 日本;JP |
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| 摘要： | |||
| 搜索关键词： | 尖峰 噪声 消除 电路 使用 数字 系统 iic 总线 | ||
1、一种尖峰噪声消除电路，其特征在于，
对输入信号和以应该消除的噪声的最大脉冲宽度作为延迟量使上述输入信号延迟的第1延迟信号进行电平一致检测，用上述电平一致检测的结果所得到的信号，对上述输入信号或使上述输入信号延迟一定时间的第2延迟信号的某一个进行取样，从而消除上述输入信号的尖峰噪声。
2、如权利要求1所述的尖峰噪声消除电路，其特征在于，
作为使上述输入信号延迟一定时间的第2延迟信号，使用上述电平一致检测中所使用的上述第1延迟信号。
3、如权利要求1所述的尖峰噪声消除电路，其特征在于，
作为使上述输入信号延迟一定时间的第2延迟信号，使用通过延迟电路进行了延迟的信号，该延迟电路使上述输入信号延迟规定时间。
4、如权利要求1～3中任一项所述的尖峰噪声消除电路，其特征在于，
通过双稳态多谐振荡器对上述输入信号或使上述输入信号延迟一定时间的第2延迟信号进行取样，在该双稳态多谐振荡器的时钟输入端子输入使一致门的输出信号延迟的信号，并在该双稳态多谐振荡器的数据输入端子输入上述输入信号或使上述输入信号延迟一定时间的第2延迟信号，该一致门进行上述电平一致检测。
5、一种数字系统，是在输入接口部进行尖峰噪声消除的结构的数字系统，其特征在于，
通过权利要求1～4中任一项所述的尖峰噪声消除电路进行上述尖峰噪声的消除。
6、一种IIC总线，是在输入接口部进行尖峰噪声消除的结构的IIC总线，其特征在于，
通过权利要求1～4中任一项所述的尖峰噪声消除电路进行上述尖峰噪声的消除。
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